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单片机开发 读写器与射频卡通信的设计采用RC522射频读写芯片与射频卡进行通信
读写器与射频卡通信的设计采用RC522射频读写芯片与射频卡进行通信，符合ISO14443规范协议；硬件系统设计中主要有AVR单片机主控模块、电源模块、存储模块、外部时钟模块、LCD模块；软件系统设计采用C语言，遵循模块化和结构化编程模式，设计了射频卡操作程序、软关机与自动关机程序、LCD显示、串行Flash存储器、外部时钟等外 ...
技术资料 基于AT89S52单片机的遥控电子钟设计
遥控电子钟的发明给我们日常的生活和学习带来了很大的便利。本文所设计的电子钟以AT89S52单片机为核心,配合红外发送与接收模块、蜂鸣器模块、时钟模块、按键模块、液晶显示模块、温度采集模块。该电子钟读数便捷、显示直观、功能丰富、电路简单、成本低廉,还可远程操控,拥有广阔的市场。The invention of the remote-contro ...
无线通信 基于PLC与GPRS、ZigBee的路灯无线控制系统
基于PLC与无线通讯模块相结合的路灯控制方案，采用了组态软件、PLC控制模块、单片机采集模块、GRPS通信模块、ZigBee无线模块等技术，灵活控制路灯的工作状态，为路灯照明系统提供稳定、可靠、低成本的实施方案，不仅大大节约了铺设通信电缆的费用，而且达到了节能的目的。
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VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.1 简单的可编程单脉冲发生器 9.1.1 由系统功能描述时序关系 9.1.2 流程图的设计 9.1.3 系统功能描述
基于Verilog-HDL的硬件电路的实现
9.1 简单的可编程单脉冲发生器
9.1.1 由系统功能描述时序关系
9.1.2 流程图的设计
9.1.3 系统功能描述
9.1.4 逻辑框图
9.1.5 延时模块的详细描述及仿真
9.1.6 功能模块Verilog-HDL描述的模块化方法
9.1.7 输入检测模块的详细描述及仿真
9.1.8 计 ...
技术资料 基于FPGA的串口通信电路设计
串行通信接口是一种应用广泛的通信接口。目前，大部分处理器都集成了支持RS一232接口的通用异步收发器，本文基于FPGA开发板设计了一个串口数据采集和处理程序，介绍了用Verilog HDL硬件描述语言来开发波特率发生器、接收模块和发送模块这三个模块，以及系统各个模块的具体设计方法和原理，用Quartus II软件进行仿真并给出结 ...
技术资料 Verilog HDL程序设计与实践
本书通过100多个模块实例，详细地讲解了veriloghdl程序设计语言，全书共分13章，内容涉及veriloghdl语言基本概念、建模、同步设计、异步设计、功能验证等，实例包括各种加法器/计数器、乘法器/除法器、编码器/译码器、状态机、spimastercontroller、i2cmastercontroller、canprotocolcontroller、memory模块、jpeg图像压缩 ...
SQL Server 本系统采用A. 系统需求分析报告(设计方法/数据流图/数据字典) B. 数据库的信息要求报告（E—R图及关系数据模型） C. 数据库的操作和应用要求报告（模块结构图<概念结构设计及逻辑结构设计&
本系统采用A. 系统需求分析报告(设计方法/数据流图/数据字典) B. 数据库的信息要求报告（E—R图及关系数据模型） C. 数据库的操作和应用要求报告（模块结构图<概念结构设计及逻辑结构设计>） D. 调试中出现的问题及解决方法（物理设计,调试及运行，维护） E. 访问数据库的方式(ODBC, ...
其他 本程序用于测试实时时钟模块SD2000系列功能之一:四种中断功能 程序功能如下： 1.在SD2000试验板上显示实时时间的小时和分钟? 2./INT1 到指定时刻时输出低电平. 3./INT2输出固定
本程序用于测试实时时钟模块SD2000系列功能之一:四种中断功能 程序功能如下： 1.在SD2000试验板上显示实时时间的小时和分钟? 2./INT1 到指定时刻时输出低电平. 3./INT2输出固定频率32768HZ. 4.测试每分钟边沿中断输出(INT MODE3)和每分钟固定中断输出(INT MODE4)功能 ...
操作系统开发 此版本是在网上广为流传的 二级文件系统 基础上制作的.重新编写了块操作等模块,修正了N多BUG. 实现的命令有 ls-列目录 md-创建目录 cd-进入子目录 mf-创建文件 cat-显示文件内
此版本是在网上广为流传的 二级文件系统 基础上制作的.重新编写了块操作等模块,修正了N多BUG.
实现的命令有 ls-列目录 md-创建目录 cd-进入子目录 mf-创建文件 cat-显示文件内容 del-删除文件 vi-简单文件编辑 reg-注册用户管理 q-退出
超级雷电 ...
人物传记/成功经验 模块使用外部滤波器回路来抑制信号抖动和电磁干扰。滤波器回路由PLL接在滤波器输入引脚PLLF和PLLF2之间的电阻Rl和电容Cl、C2组成。电容 Cl、C2必须为无极性电容。在不同的振荡器频率下
模块使用外部滤波器回路来抑制信号抖动和电磁干扰。滤波器回路由PLL接在滤波器输入引脚PLLF和PLLF2之间的电阻Rl和电容Cl、C2组成。电容 Cl、C2必须为无极性电容。在不同的振荡器频率下，R1、Cl、C2的取值不同，常用的参数组合如表l所列。PLL模块的电源引脚PLLVCCA分别通过磁珠和0.1μF的电容与数字电源引脚VDD和数字地引脚V ...