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VHDL/FPGA/Verilog 实现dds功能
实现dds功能,利用quartus软件,
子模块包括加法器,锁相环,date-rom
利用原图将各模块综合,利用ps2键盘控制频率及相位。
VHDL/Verilog/EDA源码 布斯乘法器
booth算法通过移位运算代替某些加法运算提高乘法器的运算速度,是一种补码乘法的算法。包含乘法器模块和测试模块。
技术资料 DATLV5618.rar
TLV5618驱动程序。本压缩包是已经调试好的模块,电子设计大赛时用到得模块,根据需要自己添加到工程中去。
技术资料 简易相频特性测试仪程序
程序实现了基于MSP430F1611的简易相位测量仪的功能。主要包含DDS正弦信号发生模块,ADC采集模块等,稍作改动即可应用
技术资料 PCB高级设计—手机专题
手机设计包含了射频、音视频模拟、数字、电源管理这些典型的电路模块,这里我们就拿手机设计为例来理解各功能模块。
行业应用文档 I2C总线串行数据接口的Verilog 实现
本文介绍了I2C总线规范,并根据该规范对I2C进行模块化设计,用Verilog HDL 语言对每个模块进行具体描述,并通过模块之间的调用,基本实现了I2C的主机从机的发送和接收功能。关
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无密码,按CLOSE就可。
本书重点介绍MATLAB中功能非常强大的动态系统住址工具Simulink。本书对如何使用Simulink做了极为详细的介绍、内容包括;建模与住址入门,模型创建,运行仿真,住址结果分析,住址模块库及模块,模型和模块参数说明,系统函数编写与使用等。 ...
系统设计方案 教学管理系统是一个教育单位不可缺少的部分,它对于学校的决策者和管理者来说都至关重要。我做的是教学管理系统中的一部分
教学管理系统是一个教育单位不可缺少的部分,它对于学校的决策者和管理者来说都至关重要。我做的是教学管理系统中的一部分,包括管理员模块、教学计划模块和教师管理模块
单片机开发 Verlog HDL 写得一款32路方波发生器
Verlog HDL 写得一款32路方波发生器,例子是4路可以自己加,相位可调,频率可调,占空比可调。具体参见readme.doc.此处只提供了源码包含顶层模块sgs32.v 子模块dds.v和pll设置模块altp.v及波形驱动文件
SQL Server 后台数据库使用SQL Server
后台数据库使用SQL Server,前台开发工具使用Visual C++,中间层采用ADO数据访问技术,将对数据库的操作以类的形式封装.主要由基本信息设置、内部资料管理、数据统计模块、收费管理模块、系统用户管理等模块构成。