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汇编语言  设有十个学生的成绩分别为56 69 84 82 73 88 99 63 100 80。编制程序分别统计低于60分

设有十个学生的成绩分别为56 69 84 82 73 88 99 63 100 80。编制程序分别统计低于60分，60-90 67-97，80-89，90-99和100分的人数，并存放于s5,s6,s7,s8,s9,s10中

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分 100 69 63

网络  DSR-UU is a DSR implementation that runs in Linux and in the ns-2 network simulator. DSR-UU imple

DSR-UU is a DSR implementation that runs in Linux and in the ns-2 network simulator. DSR-UU implements most of the basic DSR features specified in the DSR draft (version 10). One big exception is flow extensions. DSR-UU does NOT use ARP, so do not be surprised if you do not see ARP traffic. DSR-UU ...

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DSR-UU implementation simulator network

单片机开发  无刷电机驱动器源代码。基于无传感器方案的无刷电机启动器。核心是换向角度检测：即电机反电势波形数据处理

无刷电机驱动器源代码。基于无传感器方案的无刷电机启动器。核心是换向角度检测：即电机反电势波形数据处理，经过衰减滤波，取出过零相位。应为低速反电势波形dB过小，波形扰动太大，本程序还不能稳定处理10Hz以下的换向计算。 ...

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无刷电机无传感器方案启动器

数据结构  给定一个数组A

给定一个数组A，里面只出现0-9这10个数字，但不一定全部出现，然后给定一个K的值，求A中大于K的整数当中最小的一个，并输出。例如A={0，1}， k =12,则结果为100. vc++ 2005环境

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数组

汇编语言  汇编程序的中断程序的设计方法 int 21H的1号、2号、9号功能的使用使用21H中断的9号功能

汇编程序的中断程序的设计方法 int 21H的1号、2号、9号功能的使用使用21H中断的9号功能，输出提示信息，并使用1号功能从键盘输入2个小于10的数，计算其和，并将和存放在存储单元R中。

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21H int 汇编程序中断程序

3G开发  随机产生长度大于1000的‘0’、‘1’信号序列

随机产生长度大于1000的‘0’、‘1’信号序列，对其进行BPSK，QPSK，16QAM调制，给出： 1）低通滤波器后的波形（只画10个周期）； 2）信号眼图，对其进行讨论（画出5个信号周期）； 3）信号带内、带外功率谱密度（低通滤波器参数自定），并对其进行讨论。 ...

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1000 随机长度信号

文章/文档  提出了一个采用(2,1,7)卷积码+QPSK的中频调制解调方案,并在Xilinx公司的100万门FPGA芯片上实现了该系统。该系统在信噪比SNR为6dB左右时可实现速率超过1Mbit/s、误码率

提出了一个采用(2,1,7)卷积码+QPSK的中频调制解调方案,并在Xilinx公司的100万门FPGA芯片上实现了该系统。该系统在信噪比SNR为6dB左右时可实现速率超过1Mbit/s、误码率小于10-5的数据传输。

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Xilinx QPSK FPGA Mbit

汇编语言  该程序可以实现数据的接收、排序并显示

该程序可以实现数据的接收、排序并显示，其中，排序包括从小到大、从大到小，使用者可以根据自己的需要自行选择。程序可以提示输入一组数（最多10个），接收并显示，将接收到的数选择从大到小或者从小到大的顺序排列。 ...

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程序数据接收排序

其他书籍  Number of Namespaces in the project: 1 Number of Classes in the project: 6 Number of C# function

Number of Namespaces in the project: 1 Number of Classes in the project: 6 Number of C# function(s) in the project: 2 Number of C# subroutine(s) in the project: 15 Number of VB.NET function(s) in the project: 1 Number of VB.NET subroutine(s) in the project: 10 Number of Application variable(s) use ...

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Number project Namespaces the

VHDL/FPGA/Verilog 文件名：ADC0809.vhd功能：基于VHDL语言

文件名：ADC0809.vhd功能：基于VHDL语言，实现对ADC0809简单控制说明：ADC0809没有内部时钟，需外接10KHz~1290Hz的时钟号，这里由FPGA的系统时钟（50MHz）经256分频得到clk1（195KHz）作为ADC0809转换工作时钟。

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0809 VHDL ADC vhd

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