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https://www.eeworm.com/dl/663/459166.html
VHDL/FPGA/Verilog
用VHDL语言设计简单的CPU
用VHDL语言设计简单的CPU，重点设计微操作代码，然后设计CPU各组成模块，最后根据设计的微操作设计微指令，验证设计的正确性。可基本实现加、减、乘、除、移位、循环等操作。
https://www.eeworm.com/dl/542/461889.html
其他书籍
在用SolidWorks 设计完几何模型后
在用SolidWorks 设计完几何模型后，您可以使用COSMOS/Works 对其进行分析。分析模型的第一步是建立一个设计专题。
https://www.eeworm.com/dl/663/463172.html
VHDL/FPGA/Verilog
用Verilog HDL编写的秒表设计
用Verilog HDL编写的秒表设计，可以实现百分之一秒，十分之一秒，秒，十秒等功能。