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https://www.eeworm.com/dl/619/145471.html
Linux/Unix编程
完整的1.0代码
完整的1.0代码，可直接在windows下打开，另外介绍一款windos下查看linux代码的工具Source Insight，非常好用
https://www.eeworm.com/dl/663/155193.html
VHDL/FPGA/Verilog
汉明码的编结码模块
汉明码的编结码模块，用verilog写成，为Modelsim下的一个工程。
https://www.eeworm.com/dl/619/159625.html
Linux/Unix编程
linux0.11代码
linux0.11代码，经过阅读这些代码你可以很轻松地进入内核学习，祝大家学习快乐
https://www.eeworm.com/dl/663/160383.html
VHDL/FPGA/Verilog
输入为8421BCD码
输入为8421BCD码，输出为8421BCD码。
程序中自动对输入进行转换，将8421BCD转换成余3码，然后采用修正函数实现加法，并且利用程序将加法结果转换成8421BCD码进行输出，且输出转换前后的中间结果。