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数字频率计的设计与制作 的查询结果
VHDL/FPGA/Verilog 基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码
基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码，其功能主要有：时间设置，时间显示，跑表，分频，日期设置，日期显示等
VHDL/FPGA/Verilog 用verillog HDL 写的数字频率计.在实验箱上测试通过
用verillog HDL 写的数字频率计.在实验箱上测试通过
VHDL/FPGA/Verilog Verilog HDL下的4 位数字频率计控制模块源代码
Verilog HDL下的4 位数字频率计控制模块源代码
单片机开发 1、数字锁相环的单片机代码。 2、单片机与数字锁相环MC145152的应用系统的设计与实现。
1、数字锁相环的单片机代码。
2、单片机与数字锁相环MC145152的应用系统的设计与实现。
VHDL/FPGA/Verilog 采用VerilogHDL语言编写的数字频率计
采用VerilogHDL语言编写的数字频率计
文件格式 此为使用DDS直接数字频率合成器之设计报告,作者相当的详细介绍DDS之原理以及使用Altera之FPGA做设计,供使用者参考.
此为使用DDS直接数字频率合成器之设计报告,作者相当的详细介绍DDS之原理以及使用Altera之FPGA做设计,供使用者参考.
VHDL/FPGA/Verilog :介绍了基于FPGA的FIR数字滤波器的设计与实现,该设计利用Matlab工具箱设计窗函数计算FIR滤波器系数,并通过VHDL层次化设计方法,同时FPGA与单片机有机结合,采用C51及VHDL语言模块
:介绍了基于FPGA的FIR数字滤波器的设计与实现,该设计利用Matlab工具箱设计窗函数计算FIR滤波器系数,并通过VHDL层次化设计方法,同时FPGA与单片机有机结合,采用C51及VHDL语言模块化的设计思想及进行优化编程,有效实现了键盘可设置参数及LCD显示。结果表明此实现结构能进一步完善数据的快速处理和有效控制,提高了设计的灵活性 ...
VHDL/FPGA/Verilog 用Verilog HDL / VHDL实现的数字频率计（完整实验报告）
用Verilog HDL / VHDL实现的数字频率计（完整实验报告）
单片机开发 用51单片机做的数字频率计
用51单片机做的数字频率计，精度非常高，计数误差不超过1Hz。量程0--65535.
VHDL/FPGA/Verilog 基于VHDL的简易数字频率计
基于VHDL的简易数字频率计，具体功能不清楚请大家验证！