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https://www.eeworm.com/dl/663/159492.html
VHDL/FPGA/Verilog
FIR滤波器的verilog实现
FIR滤波器的verilog实现，实现6级流水线的程序设计。
https://www.eeworm.com/dl/648/163253.html
单片机开发
由8031内部定时器1
由8031内部定时器1，编写程序模拟一时序控制装置。包括了中断方式，查询方式。占空比变化，占空比固定方式。中断现场保护