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https://www.eeworm.com/dl/504/16169.html
VHDL/Verilog/EDA源码
AGC verilog实现
verilog实现一个AGC模块，信号输入位宽16位，通过统计64个输入完成其功率的统计，然后根据功率大小对信号进行缩放。