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VHDL/Verilog/EDA源码
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AGC verilog实现
AGC verilog实现
VHDL/Verilog/EDA源码
4134 K
31 次下载
2013-06-09
资源详细信息
文件格式
RAR
文件大小
4134 K
资源分类
VHDL/Verilog/EDA源码
上传者
zcxzcx
发布时间
2013-06-09 01:30
下载统计
31
次
所需积分
2 积分
AGC verilog实现 - 资源详细说明
verilog实现一个AGC模块,信号输入位宽16位,通过统计64个输入完成其功率的统计,然后根据功率大小对信号进行缩放。
AGC verilog实现 - 源码文件列表
本资源包含 100 个源码文件
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1
mymult_inst.v
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2
agc.done
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3
agc.root_partition.cmp.hdb
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4
agc.root_partition.map.kpt
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5
agc.root_partition.cmp.kpt
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6
agc.root_partition.map.hdb
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7
agc.root_partition.cmp.logdb
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8
agc.db_info
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9
agc.root_partition.cmp.re.rcfdb
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10
agc.root_partition.map.cdb
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11
agc.root_partition.cmp.cdb
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12
agc.root_partition.cmp.dfp
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13
agc.root_partition.map.dpi
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14
agc.root_partition.cmp.rcfdb
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15
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