2fsk_final.fit.rpt
来自「全数字fsk调制解调的实现 verilog源码」· RPT 代码 · 共 755 行 · 第 1/5 页
RPT
755 行
; fsk[7] ; 59 ; -- ; 16 ; no ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; fsk[6] ; 60 ; -- ; 15 ; no ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; fsk[5] ; 62 ; -- ; 12 ; no ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; fsk[4] ; 63 ; -- ; 11 ; no ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; fsk[3] ; 64 ; -- ; 10 ; no ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; fsk[2] ; 65 ; -- ; 9 ; no ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; fsk[1] ; 67 ; -- ; 8 ; no ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; fsk[0] ; 68 ; -- ; 7 ; no ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
+--------+-------+-----+------+--------------+--------------------------+---------------+----------------+-----------------+---------------+---------------+------------+---------------+--------------+
+-----------------------------------+
; All Package Pins ;
+-------+------------+--------------+
; Pin # ; Usage ; I/O Standard ;
+-------+------------+--------------+
; 1 ; #TCK ; ;
; 2 ; ^CONF_DONE ; ;
; 3 ; ^nCEO ; ;
; 4 ; #TDO ; ;
; 5 ; VCC_IO ; ;
; 6 ; GND_INT ; ;
; 7 ; GND* ; ;
; 8 ; zx ; LVTTL/LVCMOS ;
; 9 ; wf ; LVTTL/LVCMOS ;
; 10 ; pulse ; LVTTL/LVCMOS ;
; 11 ; lpf ; LVTTL/LVCMOS ;
; 12 ; GND* ; ;
; 13 ; bsyn ; LVTTL/LVCMOS ;
; 14 ; mout ; LVTTL/LVCMOS ;
; 15 ; GND_INT ; ;
; 16 ; VCC_INT ; ;
; 17 ; dout1 ; LVTTL/LVCMOS ;
; 18 ; GND* ; ;
; 19 ; GND* ; ;
; 20 ; GND* ; ;
; 21 ; GND* ; ;
; 22 ; GND* ; ;
; 23 ; GND* ; ;
; 24 ; VCC_IO ; ;
; 25 ; GND_INT ; ;
; 26 ; GND* ; ;
; 27 ; GND* ; ;
; 28 ; GND* ; ;
; 29 ; GND* ; ;
; 30 ; GND* ; ;
; 31 ; GND* ; ;
; 32 ; GND* ; ;
; 33 ; GND* ; ;
; 34 ; #TMS ; ;
; 35 ; ^nSTATUS ; ;
; 36 ; GND* ; ;
; 37 ; GND* ; ;
; 38 ; GND* ; ;
; 39 ; GND* ; ;
; 40 ; GND_INT ; ;
; 41 ; GND* ; ;
; 42 ; GND* ; ;
; 43 ; GND* ; ;
; 44 ; GND* ; ;
; 45 ; VCC_IO ; ;
; 46 ; GND* ; ;
; 47 ; GND* ; ;
; 48 ; GND* ; ;
; 49 ; GND* ; ;
; 50 ; VCC_INT ; ;
; 51 ; GND* ; ;
; 52 ; GND_INT ; ;
; 53 ; VCC_CKLK ; ;
; 54 ; GND+ ; ;
; 55 ; clk ; LVTTL/LVCMOS ;
; 56 ; GND+ ; ;
; 57 ; GND_CKLK ; ;
; 58 ; GND_INT ; ;
; 59 ; fsk[7] ; LVTTL/LVCMOS ;
; 60 ; fsk[6] ; LVTTL/LVCMOS ;
; 61 ; VCC_IO ; ;
; 62 ; fsk[5] ; LVTTL/LVCMOS ;
; 63 ; fsk[4] ; LVTTL/LVCMOS ;
; 64 ; fsk[3] ; LVTTL/LVCMOS ;
; 65 ; fsk[2] ; LVTTL/LVCMOS ;
; 66 ; GND_INT ; ;
; 67 ; fsk[1] ; LVTTL/LVCMOS ;
; 68 ; fsk[0] ; LVTTL/LVCMOS ;
; 69 ; GND* ; ;
; 70 ; GND* ; ;
; 71 ; VCC_IO ; ;
; 72 ; div64 ; LVTTL/LVCMOS ;
; 73 ; GND* ; ;
; 74 ; ^nCONFIG ; ;
; 75 ; VCC_INT ; ;
; 76 ; ^MSEL1 ; ;
; 77 ; ^MSEL0 ; ;
; 78 ; GND* ; ;
; 79 ; GND* ; ;
; 80 ; GND* ; ;
; 81 ; GND* ; ;
; 82 ; GND* ; ;
; 83 ; GND* ; ;
; 84 ; GND_INT ; ;
; 85 ; VCC_INT ; ;
; 86 ; GND* ; ;
; 87 ; GND* ; ;
; 88 ; GND* ; ;
; 89 ; GND* ; ;
; 90 ; GND* ; ;
; 91 ; GND* ; ;
; 92 ; GND* ; ;
; 93 ; GND_INT ; ;
; 94 ; VCC_IO ; ;
; 95 ; din[0] ; LVTTL/LVCMOS ;
; 96 ; din[1] ; LVTTL/LVCMOS ;
; 97 ; din[2] ; LVTTL/LVCMOS ;
; 98 ; din[3] ; LVTTL/LVCMOS ;
; 99 ; din[4] ; LVTTL/LVCMOS ;
; 100 ; din[5] ; LVTTL/LVCMOS ;
; 101 ; din[6] ; LVTTL/LVCMOS ;
; 102 ; din[7] ; LVTTL/LVCMOS ;
; 103 ; VCC_INT ; ;
; 104 ; GND_INT ; ;
; 105 ; #TDI ; ;
; 106 ; ^nCE ; ;
; 107 ; ^DCLK ; ;
; 108 ; ^DATA0 ; ;
; 109 ; GND* ; ;
; 110 ; rd ; LVTTL/LVCMOS ;
; 111 ; GND* ; ;
; 112 ; GND* ; ;
; 113 ; GND* ; ;
; 114 ; GND* ; ;
; 115 ; VCC_IO ; ;
; 116 ; GND* ; ;
; 117 ; GND* ; ;
; 118 ; GND* ; ;
; 119 ; GND* ; ;
; 120 ; GND* ; ;
; 121 ; GND* ; ;
; 122 ; GND* ; ;
; 123 ; GND_INT ; ;
; 124 ; GND+ ; ;
; 125 ; GND+ ; ;
; 126 ; GND+ ; ;
; 127 ; VCC_INT ; ;
; 128 ; GND* ; ;
; 129 ; GND_INT ; ;
; 130 ; GND* ; ;
; 131 ; GND* ; ;
; 132 ; GND* ; ;
; 133 ; GND* ; ;
; 134 ; VCC_IO ; ;
; 135 ; GND* ; ;
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