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📄 senduard.tan.rpt

📁 利用VHDL实现CPLD(EPM240T100C5)的串口发送程序
💻 RPT
📖 第 1 页 / 共 4 页
字号:
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv2[7]      ; clk16x          ; clk50      ; clk50    ; None                        ; None                      ; 2.546 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv2[7]      ; clkdiv2[6]      ; clk50      ; clk50    ; None                        ; None                      ; 2.543 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv2[7]      ; clkdiv2[4]      ; clk50      ; clk50    ; None                        ; None                      ; 2.543 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; wrn2            ; clk1x_enable    ; clk50      ; clk50    ; None                        ; None                      ; 2.516 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; no_bits_sent[2] ; no_bits_sent[3] ; clk50      ; clk50    ; None                        ; None                      ; 2.497 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; wrn2            ; tbre~reg0       ; clk50      ; clk50    ; None                        ; None                      ; 2.470 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv[0]       ; clkdiv[3]       ; clk50      ; clk50    ; None                        ; None                      ; 2.436 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; tbre~reg0       ; tbre~reg0       ; clk50      ; clk50    ; None                        ; None                      ; 2.422 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk16x          ; clk16x          ; clk50      ; clk50    ; None                        ; None                      ; 2.391 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; tsr[0]          ; tsr[1]          ; clk50      ; clk50    ; None                        ; None                      ; 2.374 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; tsr[0]          ; tsr[0]          ; clk50      ; clk50    ; None                        ; None                      ; 2.352 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv2[7]      ; clkdiv2[1]      ; clk50      ; clk50    ; None                        ; None                      ; 2.229 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; no_bits_sent[0] ; no_bits_sent[1] ; clk50      ; clk50    ; None                        ; None                      ; 2.218 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; no_bits_sent[1] ; no_bits_sent[2] ; clk50      ; clk50    ; None                        ; None                      ; 2.213 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv2[0]      ; clk16x          ; clk50      ; clk50    ; None                        ; None                      ; 2.210 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; no_bits_sent[3] ; no_bits_sent[3] ; clk50      ; clk50    ; None                        ; None                      ; 2.184 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv[1]       ; clkdiv[2]       ; clk50      ; clk50    ; None                        ; None                      ; 2.153 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv[1]       ; clkdiv[3]       ; clk50      ; clk50    ; None                        ; None                      ; 2.141 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv[1]       ; clkdiv[1]       ; clk50      ; clk50    ; None                        ; None                      ; 2.137 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk1x_enable    ; clkdiv[3]       ; clk50      ; clk50    ; None                        ; None                      ; 2.085 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; tsre~reg0       ; tsre~reg0       ; clk50      ; clk50    ; None                        ; None                      ; 2.056 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk1x_enable    ; clkdiv[2]       ; clk50      ; clk50    ; None                        ; None                      ; 2.050 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk1x_enable    ; clk1x_enable    ; clk50      ; clk50    ; None                        ; None                      ; 2.042 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; no_bits_sent[2] ; no_bits_sent[2] ; clk50      ; clk50    ; None                        ; None                      ; 2.031 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv[2]       ; clkdiv[3]       ; clk50      ; clk50    ; None                        ; None                      ; 2.026 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; tsr[1]          ; tsr[2]          ; clk50      ; clk50    ; None                        ; None                      ; 1.974 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; tsr[2]          ; tsr[3]          ; clk50      ; clk50    ; None                        ; None                      ; 1.967 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; tsr[6]          ; tsr[7]          ; clk50      ; clk50    ; None                        ; None                      ; 1.963 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; no_bits_sent[0] ; no_bits_sent[2] ; clk50      ; clk50    ; None                        ; None                      ; 1.886 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; no_bits_sent[1] ; no_bits_sent[1] ; clk50      ; clk50    ; None                        ; None                      ; 1.879 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; no_bits_sent[1] ; no_bits_sent[3] ; clk50      ; clk50    ; None                        ; None                      ; 1.874 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; no_bits_sent[0] ; no_bits_sent[0] ; clk50      ; clk50    ; None                        ; None                      ; 1.854 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv[0]       ; clkdiv[1]       ; clk50      ; clk50    ; None                        ; None                      ; 1.834 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv[0]       ; clkdiv[2]       ; clk50      ; clk50    ; None                        ; None                      ; 1.826 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv[0]       ; clkdiv[0]       ; clk50      ; clk50    ; None                        ; None                      ; 1.823 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; wrn1            ; clk1x_enable    ; clk50      ; clk50    ; None                        ; None                      ; 1.799 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; tsr[3]          ; tsr[4]          ; clk50      ; clk50    ; None                        ; None                      ; 1.772 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv[3]       ; clkdiv[3]       ; clk50      ; clk50    ; None                        ; None                      ; 1.771 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; tsr[5]          ; tsr[6]          ; clk50      ; clk50    ; None                        ; None                      ; 1.770 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; tsr[4]          ; tsr[5]          ; clk50      ; clk50    ; None                        ; None                      ; 1.762 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk             ; clk             ; clk50      ; clk50    ; None                        ; None                      ; 1.743 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk1x_enable    ; clkdiv[1]       ; clk50      ; clk50    ; None                        ; None                      ; 1.580 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk1x_enable    ; clkdiv[0]       ; clk50      ; clk50    ; None                        ; None                      ; 1.580 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clkdiv[2]       ; clkdiv[2]       ; clk50      ; clk50    ; None                        ; None                      ; 1.542 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; wrn1            ; wrn2            ; clk50      ; clk50    ; None                        ; None                      ; 1.270 ns                ;
+-------+------------------------------------------------+-----------------+-----------------+------------+----------+-----------------------------+---------------------------+-------------------------+


+----------------------------------------------------------------+
; tsu                                                            ;
+-------+--------------+------------+--------+--------+----------+
; Slack ; Required tsu ; Actual tsu ; From   ; To     ; To Clock ;
+-------+--------------+------------+--------+--------+----------+
; N/A   ; None         ; 0.512 ns   ; din[1] ; tbr[1] ; wrn      ;
; N/A   ; None         ; 0.347 ns   ; din[0] ; tbr[0] ; wrn      ;
; N/A   ; None         ; 0.099 ns   ; din[2] ; tbr[2] ; wrn      ;
; N/A   ; None         ; 0.058 ns   ; din[4] ; tbr[4] ; wrn      ;
; N/A   ; None         ; -0.155 ns  ; din[3] ; tbr[3] ; wrn      ;
; N/A   ; None         ; -0.168 ns  ; din[6] ; tbr[6] ; wrn      ;
; N/A   ; None         ; -0.168 ns  ; din[5] ; tbr[5] ; wrn      ;
; N/A   ; None         ; -0.189 ns  ; din[7] ; tbr[7] ; wrn      ;
; N/A   ; None         ; -8.815 ns  ; wrn    ; wrn1   ; clk50    ;
+-------+--------------+------------+--------+--------+----------+


+---------------------------------------------------------------------+
; tco                                                                 ;
+-------+--------------+------------+-----------+--------+------------+
; Slack ; Required tco ; Actual tco ; From      ; To     ; From Clock ;
+-------+--------------+------------+-----------+--------+------------+
; N/A   ; None         ; 23.326 ns  ; sdo~reg0  ; sdo    ; clk50      ;
; N/A   ; None         ; 22.615 ns  ; tsre~reg0 ; tsre   ; clk50      ;
; N/A   ; None         ; 18.851 ns  ; tbre~reg0 ; tbre   ; clk50      ;
; N/A   ; None         ; 11.592 ns  ; tbr[3]    ; LED[3] ; wrn        ;
; N/A   ; None         ; 11.548 ns  ; tbr[1]    ; LED[1] ; wrn        ;
; N/A   ; None         ; 11.482 ns  ; tbr[4]    ; LED[4] ; wrn        ;
; N/A   ; None         ; 11.478 ns  ; tbr[0]    ; LED[0] ; wrn        ;
; N/A   ; None         ; 10.885 ns  ; tbr[7]    ; LED[7] ; wrn        ;
; N/A   ; None         ; 10.876 ns  ; tbr[6]    ; LED[6] ; wrn        ;
; N/A   ; None         ; 10.857 ns  ; tbr[5]    ; LED[5] ; wrn        ;
; N/A   ; None         ; 9.738 ns   ; tbr[2]    ; LED[2] ; wrn        ;
+-------+--------------+------------+-----------+--------+------------+


+----------------------------------------------------------------------+
; th                                                                   ;
+---------------+-------------+-----------+--------+--------+----------+
; Minimum Slack ; Required th ; Actual th ; From   ; To     ; To Clock ;
+---------------+-------------+-----------+--------+--------+----------+
; N/A           ; None        ; 9.369 ns  ; wrn    ; wrn1   ; clk50    ;
; N/A           ; None        ; 0.743 ns  ; din[7] ; tbr[7] ; wrn      ;
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