-- 本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在 --PC机上安装一个串口调试工具来验证程序的功能。 -- 程序实现了一个收发一帧10个bit（即无奇偶校验位）的串口控 --制器，10个bit是1位起始位，8个数据位，1个结束 --位。串口的波特律由程序中定义的div_par参数决定，更改该参数可以实 --现相应的波特率。程序当前设定的div_par 的值是0x104，对应的波特率是 --9600。用一个8倍波特率的时钟将发送或接受每一位bit的周期时间 --划分为8个时隙以使通信同步. --程序的工作过程是：串口处于全双工工作状态，按动SW0，CPLD向PC发送“welcome" --字符串（串口调试工具设成按ASCII码接受方式）；PC可随时向CPLD发送0-F的十六进制 --数据，CPLD接受后显示在7段数码管上。
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上传时间： 2017-04-12
上传用户：lgnf
资源简介：Verilog HDl语言实现CPLD-EPC240与电脑的串口通讯QUARTUS逻辑工程源码 //本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在//PC机上安装一个串口调试工具来验证程序的功能。//程序实现了一个收发一帧10个bit（即无奇偶校验位）的串口控//制器，...
上传时间： 2022-02-18
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上传时间： 2016-06-17
上传用户：sunjet
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上传时间： 2016-05-09
上传用户：偷心的海盗
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上传时间： 2015-05-30
上传用户：tb_6877751
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上传时间： 2013-10-13
上传用户：330402686
资源简介：本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在PC机上安装一个串口调试工具来验证程序的功能。
上传时间： 2013-12-05
上传用户：wsf950131
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上传时间： 2016-02-16
上传用户：wfl_yy
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上传时间： 2016-01-31
上传用户：zhangzhenyu
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上传时间： 2013-12-22
上传用户：gonuiln
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上传用户：zhangliming420
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上传时间： 2013-12-20
上传用户：wyc199288
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上传时间： 2016-06-15
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上传用户：luke5347
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