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📄 _8bitfulladd.fit.rpt

📁 有用的verilog hdl实验用程序 配有截图
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📖 第 1 页 / 共 3 页
字号:
; 38    ; GND*       ;              ;
; 39    ; sum[7]     ; LVTTL/LVCMOS ;
; 40    ; GND_INT    ;              ;
; 41    ; sum[0]     ; LVTTL/LVCMOS ;
; 42    ; ina[7]     ; LVTTL/LVCMOS ;
; 43    ; GND*       ;              ;
; 44    ; GND*       ;              ;
; 45    ; VCC_IO     ;              ;
; 46    ; GND*       ;              ;
; 47    ; GND*       ;              ;
; 48    ; ina[3]     ; LVTTL/LVCMOS ;
; 49    ; GND*       ;              ;
; 50    ; VCC_INT    ;              ;
; 51    ; inb[4]     ; LVTTL/LVCMOS ;
; 52    ; GND_INT    ;              ;
; 53    ; VCC_CKLK   ;              ;
; 54    ; ina[1]     ; LVTTL/LVCMOS ;
; 55    ; inb[2]     ; LVTTL/LVCMOS ;
; 56    ; inb[1]     ; LVTTL/LVCMOS ;
; 57    ; GND_CKLK   ;              ;
; 58    ; GND_INT    ;              ;
; 59    ; GND*       ;              ;
; 60    ; GND*       ;              ;
; 61    ; VCC_IO     ;              ;
; 62    ; GND*       ;              ;
; 63    ; GND*       ;              ;
; 64    ; GND*       ;              ;
; 65    ; GND*       ;              ;
; 66    ; GND_INT    ;              ;
; 67    ; GND*       ;              ;
; 68    ; GND*       ;              ;
; 69    ; GND*       ;              ;
; 70    ; GND*       ;              ;
; 71    ; VCC_IO     ;              ;
; 72    ; GND*       ;              ;
; 73    ; GND*       ;              ;
; 74    ; ^nCONFIG   ;              ;
; 75    ; VCC_INT    ;              ;
; 76    ; ^MSEL1     ;              ;
; 77    ; ^MSEL0     ;              ;
; 78    ; GND*       ;              ;
; 79    ; GND*       ;              ;
; 80    ; GND*       ;              ;
; 81    ; GND*       ;              ;
; 82    ; GND*       ;              ;
; 83    ; GND*       ;              ;
; 84    ; GND_INT    ;              ;
; 85    ; VCC_INT    ;              ;
; 86    ; GND*       ;              ;
; 87    ; GND*       ;              ;
; 88    ; sum[3]     ; LVTTL/LVCMOS ;
; 89    ; ina[6]     ; LVTTL/LVCMOS ;
; 90    ; inb[5]     ; LVTTL/LVCMOS ;
; 91    ; ina[4]     ; LVTTL/LVCMOS ;
; 92    ; ina[5]     ; LVTTL/LVCMOS ;
; 93    ; GND_INT    ;              ;
; 94    ; VCC_IO     ;              ;
; 95    ; GND*       ;              ;
; 96    ; GND*       ;              ;
; 97    ; GND*       ;              ;
; 98    ; GND*       ;              ;
; 99    ; GND*       ;              ;
; 100   ; GND*       ;              ;
; 101   ; GND*       ;              ;
; 102   ; GND*       ;              ;
; 103   ; VCC_INT    ;              ;
; 104   ; GND_INT    ;              ;
; 105   ; #TDI       ;              ;
; 106   ; ^nCE       ;              ;
; 107   ; ^DCLK      ;              ;
; 108   ; ^DATA0     ;              ;
; 109   ; GND*       ;              ;
; 110   ; GND*       ;              ;
; 111   ; GND*       ;              ;
; 112   ; GND*       ;              ;
; 113   ; GND*       ;              ;
; 114   ; GND*       ;              ;
; 115   ; VCC_IO     ;              ;
; 116   ; GND*       ;              ;
; 117   ; GND*       ;              ;
; 118   ; GND*       ;              ;
; 119   ; GND*       ;              ;
; 120   ; GND*       ;              ;
; 121   ; GND*       ;              ;
; 122   ; GND*       ;              ;
; 123   ; GND_INT    ;              ;
; 124   ; inb[0]     ; LVTTL/LVCMOS ;
; 125   ; ina[2]     ; LVTTL/LVCMOS ;
; 126   ; ina[0]     ; LVTTL/LVCMOS ;
; 127   ; VCC_INT    ;              ;
; 128   ; GND*       ;              ;
; 129   ; GND_INT    ;              ;
; 130   ; GND*       ;              ;
; 131   ; GND*       ;              ;
; 132   ; inb[7]     ; LVTTL/LVCMOS ;
; 133   ; GND*       ;              ;
; 134   ; VCC_IO     ;              ;
; 135   ; GND*       ;              ;
; 136   ; GND*       ;              ;
; 137   ; GND*       ;              ;
; 138   ; GND*       ;              ;
; 139   ; GND_INT    ;              ;
; 140   ; sum[1]     ; LVTTL/LVCMOS ;
; 141   ; cout       ; LVTTL/LVCMOS ;
; 142   ; sum[6]     ; LVTTL/LVCMOS ;
; 143   ; inb[6]     ; LVTTL/LVCMOS ;
; 144   ; GND*       ;              ;
+-------+------------+--------------+


+-----------------------------------+
; Global & Other Fast Signals       ;
+--------+-------+---------+--------+
; Name   ; Pin # ; Fan-Out ; Global ;
+--------+-------+---------+--------+
; ina[0] ; 126   ; 1       ; no     ;
; inb[0] ; 124   ; 1       ; no     ;
; ina[1] ; 54    ; 1       ; no     ;
; inb[1] ; 56    ; 1       ; no     ;
; ina[2] ; 125   ; 1       ; no     ;
; inb[2] ; 55    ; 1       ; no     ;
+--------+-------+---------+--------+


+---------------------------------------------+
; Carry Chains                                ;
+--------------------+------------------------+
; Carry Chain Length ; Number of Carry Chains ;
+--------------------+------------------------+
; 0                  ; 0                      ;
; 1                  ; 0                      ;
; 2                  ; 0                      ;
; 3                  ; 0                      ;
; 4                  ; 0                      ;
; 5                  ; 0                      ;
; 6                  ; 0                      ;
; 7                  ; 0                      ;
; 8                  ; 0                      ;
; 9                  ; 0                      ;
; 10                 ; 1                      ;
+--------------------+------------------------+


+-----------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals                                                   ;
+-------------------------------------------------------------------------+---------+
; Name                                                                    ; Fan-Out ;
+-------------------------------------------------------------------------+---------+
; lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[1]          ; 2       ;
; lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[2]          ; 2       ;
; lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[6]          ; 2       ;
; lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[5]          ; 2       ;
; lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[3]          ; 2       ;
; lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[4]          ; 2       ;
; lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[7]          ; 2       ;
; lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[8]          ; 2       ;
; inb[2]                                                                  ; 1       ;
; lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cout[0]          ; 1       ;
; inb[7]                                                                  ; 1       ;
; ina[5]                                                                  ; 1       ;
; ina[6]                                                                  ; 1       ;
; ina[4]                                                                  ; 1       ;
; inb[3]                                                                  ; 1       ;
; ina[2]                                                                  ; 1       ;
; ina[3]                                                                  ; 1       ;
; cin                                                                     ; 1       ;
; ina[1]                                                                  ; 1       ;
; inb[5]                                                                  ; 1       ;
; ina[0]                                                                  ; 1       ;
; ina[7]                                                                  ; 1       ;
; inb[1]                                                                  ; 1       ;
; lpm_add_sub:Add0|addcore:adder|a_csnbuffer:result_node|cs_buffer[8]~184 ; 1       ;
; inb[6]                                                                  ; 1       ;
; inb[0]                                                                  ; 1       ;
; inb[4]                                                                  ; 1       ;
+-------------------------------------------------------------------------+---------+


+-------------------------------------------+
; LAB                                       ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0                        ; 214            ;
; 1                        ; 0              ;
; 2                        ; 0              ;
; 3                        ; 0              ;
; 4                        ; 0              ;
; 5                        ; 2              ;
+--------------------------+----------------+


+---------------------------------------------+
; LAB External Interconnect                   ;

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