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📄 spi_master.tan.rpt

📁 AN485_CH-MAX II CPLD 中的串行外设接口主机(verilog SPI)
💻 RPT
📖 第 1 页 / 共 5 页
字号:
; N/A   ; 113.05 MHz ( period = 8.846 ns )               ; shift_register[5] ; shift_register[6] ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.916 ns                ;
; N/A   ; 121.11 MHz ( period = 8.257 ns )               ; shift_register[2] ; shift_register[3] ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.327 ns                ;
; N/A   ; 121.12 MHz ( period = 8.256 ns )               ; shift_register[3] ; shift_register[4] ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.326 ns                ;
; N/A   ; 121.18 MHz ( period = 8.252 ns )               ; shift_register[4] ; shift_register[5] ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.322 ns                ;
; N/A   ; 121.43 MHz ( period = 8.235 ns )               ; shift_register[6] ; shift_register[7] ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.305 ns                ;
; N/A   ; 122.32 MHz ( period = 8.175 ns )               ; shift_register[1] ; shift_register[2] ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.245 ns                ;
; N/A   ; 188.57 MHz ( period = 5.303 ns )               ; count[0]          ; count[3]          ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.543 ns                ;
; N/A   ; 196.39 MHz ( period = 5.092 ns )               ; sclk~reg0         ; sclk~reg0         ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.332 ns                ;
; N/A   ; 198.33 MHz ( period = 5.042 ns )               ; count[1]          ; count[2]          ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.282 ns                ;
; N/A   ; 198.73 MHz ( period = 5.032 ns )               ; count[1]          ; count[1]          ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.272 ns                ;
; N/A   ; 199.68 MHz ( period = 5.008 ns )               ; count[3]          ; count[3]          ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.248 ns                ;
; N/A   ; 203.50 MHz ( period = 4.914 ns )               ; count[0]          ; count[1]          ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.154 ns                ;
; N/A   ; 203.87 MHz ( period = 4.905 ns )               ; count[0]          ; count[2]          ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.145 ns                ;
; N/A   ; 203.96 MHz ( period = 4.903 ns )               ; count[1]          ; count[3]          ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.143 ns                ;
; N/A   ; 204.00 MHz ( period = 4.902 ns )               ; count[0]          ; count[0]          ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.142 ns                ;
; N/A   ; 211.55 MHz ( period = 4.727 ns )               ; count[2]          ; count[3]          ; pro_clk    ; pro_clk  ; None                        ; None                      ; 0.967 ns                ;
; N/A   ; 211.77 MHz ( period = 4.722 ns )               ; count[2]          ; count[2]          ; pro_clk    ; pro_clk  ; None                        ; None                      ; 0.962 ns                ;
; N/A   ; 291.97 MHz ( period = 3.425 ns )               ; clk_divide[1]     ; clk_divide[5]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.982 ns                ;
; N/A   ; 291.97 MHz ( period = 3.425 ns )               ; clk_divide[1]     ; clk_divide[6]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.982 ns                ;
; N/A   ; 291.97 MHz ( period = 3.425 ns )               ; clk_divide[1]     ; clk_divide[7]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.982 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[0]     ; clk_divide[5]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.836 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[0]     ; clk_divide[6]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.836 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[0]     ; clk_divide[7]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.836 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[1]     ; clk_divide[4]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.691 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; spi_word_send     ; slave_cs          ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.662 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[1]     ; clk_divide[3]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.614 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[0]     ; clk_divide[4]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.545 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[1]     ; clk_divide[2]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.537 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[0]     ; clk_divide[3]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.468 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[0]     ; clk_divide[2]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.391 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; spi_word_send     ; rxdata[1]         ; pro_clk    ; pro_clk  ; None                        ; None                      ; 3.448 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; spi_word_send     ; rxdata[2]         ; pro_clk    ; pro_clk  ; None                        ; None                      ; 3.448 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; spi_word_send     ; rxdata[3]         ; pro_clk    ; pro_clk  ; None                        ; None                      ; 3.448 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; spi_word_send     ; rxdata[4]         ; pro_clk    ; pro_clk  ; None                        ; None                      ; 3.448 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; spi_word_send     ; rxdata[5]         ; pro_clk    ; pro_clk  ; None                        ; None                      ; 3.448 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[5]     ; clk_divide[7]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.243 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[3]     ; clk_divide[5]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.198 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[3]     ; clk_divide[6]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.198 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[3]     ; clk_divide[7]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.198 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[5]     ; clk_divide[6]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.166 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[2]     ; clk_divide[5]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.141 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[2]     ; clk_divide[6]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.141 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[2]     ; clk_divide[7]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.141 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[4]     ; clk_divide[5]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.086 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[4]     ; clk_divide[6]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.086 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[4]     ; clk_divide[7]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.086 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[6]     ; clk_divide[7]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.995 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[1]     ; clk_divide[1]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.939 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[3]     ; clk_divide[4]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.907 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[0]     ; clk_divide[1]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.861 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[2]     ; clk_divide[4]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.850 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[2]     ; clk_divide[3]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.773 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; control[3]        ; slave_cs          ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.741 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[5]     ; clk_divide[5]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.568 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[6]     ; clk_divide[6]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.465 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[3]     ; clk_divide[3]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.309 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[4]     ; clk_divide[4]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.298 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; data_out[0]       ; data_out[0]       ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.297 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[2]     ; clk_divide[2]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.243 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[7]     ; clk_divide[7]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.220 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; slave_cs          ; slave_cs          ; pro_clk    ; pro_clk  ; None                        ; None                      ; 1.089 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; clk_divide[0]     ; clk_divide[0]     ; pro_clk    ; pro_clk  ; None                        ; None                      ; 0.927 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; spi_word_send     ; rxdata[6]         ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.713 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; spi_word_send     ; rxdata[7]         ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.713 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; spi_word_send     ; rxdata[0]         ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.713 ns                ;
; N/A   ; Restricted to 304.04 MHz ( period = 3.289 ns ) ; slave_cs          ; sclk~reg0         ; pro_clk    ; pro_clk  ; None                        ; None                      ; 2.719 ns                ;
+-------+------------------------------------------------+-------------------+-------------------+------------+----------+-----------------------------+---------------------------+-------------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Hold: 'pro_clk'                                                                                                                                                                         ;
+------------------------------------------+-------------------+-------------------+------------+----------+----------------------------+----------------------------+--------------------------+
; Minimum Slack                            ; From              ; To                ; From Clock ; To Clock ; Required Hold Relationship ; Required Shortest P2P Time ; Actual Shortest P2P Time ;
+------------------------------------------+-------------------+-------------------+------------+----------+----------------------------+----------------------------+--------------------------+
; Not operational: Clock Skew > Data Delay ; shift_register[1] ; shift_register[2] ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.245 ns                 ;
; Not operational: Clock Skew > Data Delay ; shift_register[6] ; shift_register[7] ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.305 ns                 ;
; Not operational: Clock Skew > Data Delay ; shift_register[4] ; shift_register[5] ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.322 ns                 ;
; Not operational: Clock Skew > Data Delay ; shift_register[3] ; shift_register[4] ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.326 ns                 ;
; Not operational: Clock Skew > Data Delay ; shift_register[2] ; shift_register[3] ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.327 ns                 ;
; Not operational: Clock Skew > Data Delay ; shift_register[7] ; mosi~reg0         ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.510 ns                 ;
; Not operational: Clock Skew > Data Delay ; shift_register[5] ; shift_register[6] ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.916 ns                 ;
; Not operational: Clock Skew > Data Delay ; shift_register[0] ; shift_register[1] ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.988 ns                 ;
; Not operational: Clock Skew > Data Delay ; control[3]        ; sclk~reg0         ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.524 ns                 ;
; Not operational: Clock Skew > Data Delay ; slave_cs          ; sclk~reg0         ; pro_clk    ; pro_clk  ; None                       ; None                       ; 2.719 ns                 ;
; Not operational: Clock Skew > Data Delay ; count[2]          ; count[2]          ; pro_clk    ; pro_clk  ; None                       ; None                       ; 0.962 ns                 ;
; Not operational: Clock Skew > Data Delay ; count[2]          ; count[3]          ; pro_clk    ; pro_clk  ; None                       ; None                       ; 0.967 ns                 ;
; Not operational: Clock Skew > Data Delay ; count[0]          ; count[0]          ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.142 ns                 ;
; Not operational: Clock Skew > Data Delay ; count[1]          ; count[3]          ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.143 ns                 ;
; Not operational: Clock Skew > Data Delay ; count[0]          ; count[2]          ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.145 ns                 ;
; Not operational: Clock Skew > Data Delay ; count[0]          ; count[1]          ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.154 ns                 ;
; Not operational: Clock Skew > Data Delay ; count[3]          ; count[3]          ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.248 ns                 ;
; Not operational: Clock Skew > Data Delay ; count[1]          ; count[1]          ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.272 ns                 ;
; Not operational: Clock Skew > Data Delay ; count[1]          ; count[2]          ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.282 ns                 ;
; Not operational: Clock Skew > Data Delay ; sclk~reg0         ; sclk~reg0         ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.332 ns                 ;
; Not operational: Clock Skew > Data Delay ; count[0]          ; count[3]          ; pro_clk    ; pro_clk  ; None                       ; None                       ; 1.543 ns                 ;
+------------------------------------------+-------------------+-------------------+------------+----------+----------------------------+----------------------------+--------------------------+


+--------------------------------------------------------------------------------+
; tsu                                                                            ;
+-------+--------------+------------+-------------+-------------------+----------+
; Slack ; Required tsu ; Actual tsu ; From        ; To                ; To Clock ;
+-------+--------------+------------+-------------+-------------------+----------+
; N/A   ; None         ; 2.546 ns   ; CS          ; data_out[7]       ; pro_clk  ;
; N/A   ; None         ; 2.546 ns   ; CS          ; data_out[6]       ; pro_clk  ;
; N/A   ; None         ; 2.546 ns   ; CS          ; data_out[5]       ; pro_clk  ;
; N/A   ; None         ; 2.546 ns   ; CS          ; data_out[3]       ; pro_clk  ;
; N/A   ; None         ; 2.546 ns   ; CS          ; data_out[4]       ; pro_clk  ;
; N/A   ; None         ; 2.546 ns   ; CS          ; data_out[2]       ; pro_clk  ;
; N/A   ; None         ; 2.546 ns   ; CS          ; data_out[1]       ; pro_clk  ;
; N/A   ; None         ; 2.490 ns   ; addr[1]     ; control[2]        ; pro_clk  ;
; N/A   ; None         ; 2.483 ns   ; addr[1]     ; control[3]        ; pro_clk  ;
; N/A   ; None         ; 2.483 ns   ; addr[1]     ; control[5]        ; pro_clk  ;
; N/A   ; None         ; 2.483 ns   ; addr[1]     ; control[6]        ; pro_clk  ;
; N/A   ; None         ; 2.483 ns   ; addr[1]     ; control[7]        ; pro_clk  ;
; N/A   ; None         ; 2.483 ns   ; addr[1]     ; control[4]        ; pro_clk  ;
; N/A   ; None         ; 2.462 ns   ; CS          ; control[2]        ; pro_clk  ;
; N/A   ; None         ; 2.455 ns   ; CS          ; control[3]        ; pro_clk  ;
; N/A   ; None         ; 2.455 ns   ; CS          ; control[5]        ; pro_clk  ;
; N/A   ; None         ; 2.455 ns   ; CS          ; control[6]        ; pro_clk  ;
; N/A   ; None         ; 2.455 ns   ; CS          ; control[7]        ; pro_clk  ;
; N/A   ; None         ; 2.455 ns   ; CS          ; control[4]        ; pro_clk  ;
; N/A   ; None         ; 2.371 ns   ; WR          ; control[2]        ; pro_clk  ;

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