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AN485_CH-MAX II CPLD 中的串行外设接口主机（verilog SPI）

VHDL/FPGA/Verilog 306 K 146 次下载 2013-12-14

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306 K

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VHDL/FPGA/Verilog

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2013-12-14 10:45

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AN485_CH-MAX II CPLD 中的串行外设接口主机（verilog SPI） - 资源详细说明

AN485_CH-MAX II CPLD 中的串行外设接口主机（verilog SPI）

AN485_CH-MAX II CPLD 中的串行外设接口主机（verilog SPI） - 源码文件列表

本资源包含 77 个源码文件支持在线预览，点击文件名即可查看

1

wave.bmp

2

_info

3

_primary.dat

4

_primary.vhd

5

verilog.psm

6

_primary.dat

7

_primary.vhd

8

verilog.psm

9

spi_master.cr.mti

10

wave.do

11

spi_master_test.v.bak

12

spi_master_test.v

13

transcript

14

spi_master.mpf

15

vsim.wlf

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#CPLD #Verilog #SPI #CH-MAX II

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