uart.fit.rpt
来自「quatus II 环境下vhdl实现RS232功能」· RPT 代码 · 共 673 行 · 第 1/5 页
RPT
673 行
; -- 0 input functions ; 13 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 133 ;
; -- arithmetic mode ; 38 ;
; -- qfbk mode ; 10 ;
; -- register cascade mode ; 0 ;
; -- synchronous clear/load mode ; 22 ;
; -- asynchronous clear/load mode ; 82 ;
; ; ;
; Total LABs ; 22 / 127 ( 17 % ) ;
; Logic elements in carry chains ; 43 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 22 / 116 ( 19 % ) ;
; -- Clock pins ; 1 ;
; Global signals ; 4 ;
; UFM blocks ; 0 / 1 ( 0 % ) ;
; Global clocks ; 4 / 4 ( 100 % ) ;
; Maximum fan-out node ; clk ;
; Maximum fan-out ; 93 ;
; Highest non-global fan-out signal ; rst_n ;
; Highest non-global fan-out ; 66 ;
; Total fan-out ; 705 ;
; Average fan-out ; 3.65 ;
+---------------------------------------------+----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+-----------------+----------+--------------+--------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Location assigned by ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+-----------------+----------+--------------+--------------+----------------------+
; clk ; 18 ; 1 ; 0 ; 7 ; 5 ; 93 ; 0 ; yes ; no ; no ; Off ; LVTTL ; User ;
; rst_n ; 131 ; 2 ; 8 ; 11 ; 2 ; 66 ; 0 ; no ; no ; no ; Off ; LVTTL ; User ;
; rxd ; 49 ; 4 ; 7 ; 3 ; 2 ; 7 ; 0 ; no ; no ; no ; Off ; LVTTL ; User ;
; sel[0] ; 139 ; 2 ; 5 ; 11 ; 1 ; 3 ; 0 ; no ; no ; no ; Off ; LVTTL ; User ;
; sel[1] ; 138 ; 2 ; 5 ; 11 ; 0 ; 3 ; 0 ; no ; no ; no ; Off ; LVTTL ; User ;
; sel[2] ; 4 ; 1 ; 0 ; 9 ; 0 ; 2 ; 0 ; no ; no ; no ; Off ; LVTTL ; User ;
; txd_startH ; 102 ; 3 ; 17 ; 7 ; 0 ; 1 ; 0 ; no ; no ; no ; Off ; LVTTL ; User ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+-----------------+----------+--------------+--------------+----------------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+--------------+-------+----------+--------------+--------------+-------------+-----------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+------------------------+----------------------+-------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Fast Output Connection ; Location assigned by ; Load ;
+--------------+-------+----------+--------------+--------------+-------------+-----------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+------------------------+----------------------+-------+
; dig1 ; 137 ; 2 ; 6 ; 11 ; 3 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; User ; 10 pF ;
; dig2 ; 43 ; 4 ; 5 ; 3 ; 3 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; User ; 10 pF ;
; dig3 ; 42 ; 4 ; 4 ; 3 ; 0 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; User ; 10 pF ;
; dig4 ; 101 ; 3 ; 17 ; 7 ; 4 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; User ; 10 pF ;
; rxd_readyH ; 48 ; 4 ; 7 ; 3 ; 3 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; User ; 10 pF ;
; seven_seg[0] ; 44 ; 4 ; 5 ; 3 ; 2 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; User ; 10 pF ;
; seven_seg[1] ; 50 ; 4 ; 7 ; 3 ; 1 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; User ; 10 pF ;
; seven_seg[2] ; 123 ; 2 ; 9 ; 11 ; 0 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; Fitter ; 10 pF ;
; seven_seg[3] ; 134 ; 2 ; 7 ; 11 ; 2 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; User ; 10 pF ;
; seven_seg[4] ; 140 ; 2 ; 4 ; 11 ; 1 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; User ; 10 pF ;
; seven_seg[5] ; 127 ; 2 ; 9 ; 11 ; 3 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; Fitter ; 10 pF ;
; seven_seg[6] ; 45 ; 4 ; 6 ; 3 ; 0 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; User ; 10 pF ;
; seven_seg[7] ; 125 ; 2 ; 9 ; 11 ; 2 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; User ; 10 pF ;
; txd ; 129 ; 2 ; 8 ; 11 ; 0 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; User ; 10 pF ;
; txd_doneH ; 120 ; 2 ; 10 ; 11 ; 0 ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 16mA ; no ; User ; 10 pF ;
+--------------+-------+----------+--------------+--------------+-------------+-----------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+------------------------+----------------------+-------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 2 / 26 ( 8 % ) ; 3.3V ; -- ;
; 2 ; 11 / 30 ( 37 % ) ; 3.3V ; -- ;
; 3 ; 2 / 30 ( 7 % ) ; 3.3V ; -- ;
; 4 ; 7 / 30 ( 23 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+----------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; 1 ; 2 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 2 ; 3 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 3 ; 5 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 4 ; 7 ; 1 ; sel[2] ; input ; LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 5 ; 9 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 6 ; 10 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 7 ; 14 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 8 ; 15 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 9 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 10 ; ; ; GNDIO ; gnd ; ; ; -- ; ; -- ; -- ;
; 11 ; 20 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 12 ; 21 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 13 ; 22 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 14 ; 23 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 15 ; 24 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 16 ; 25 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 17 ; ; ; GNDINT ; gnd ; ; ; -- ; ; -- ; -- ;
; 18 ; 26 ; 1 ; clk ; input ; LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 19 ; ; ; VCCINT ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 20 ; 27 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 21 ; 28 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 22 ; 29 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 23 ; 30 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 24 ; 31 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 25 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 26 ; ; ; GNDIO ; gnd ; ; ; -- ; ; -- ; -- ;
; 27 ; 33 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 28 ; 36 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 29 ; 37 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 30 ; 41 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 31 ; 44 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 32 ; 47 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 33 ; 50 ; 1 ; #TMS ; input ; ; ; -- ; ; -- ; -- ;
; 34 ; 51 ; 1 ; #TDI ; input ; ; ; -- ; ; -- ; -- ;
; 35 ; 52 ; 1 ; #TCK ; input ; ; ; -- ; ; -- ; -- ;
; 36 ; 53 ; 1 ; #TDO ; output ; ; ; -- ; ; -- ; -- ;
; 37 ; 56 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 38 ; 57 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 39 ; 60 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 40 ; 62 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 41 ; 63 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 42 ; 67 ; 4 ; dig3 ; output ; LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 43 ; 68 ; 4 ; dig2 ; output ; LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 44 ; 69 ; 4 ; seven_seg[0] ; output ; LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 45 ; 74 ; 4 ; seven_seg[6] ; output ; LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 46 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 47 ; ; ; GNDIO ; gnd ; ; ; -- ; ; -- ; -- ;
; 48 ; 75 ; 4 ; rxd_readyH ; output ; LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 49 ; 76 ; 4 ; rxd ; input ; LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 50 ; 77 ; 4 ; seven_seg[1] ; output ; LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 51 ; 78 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 52 ; 79 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
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