📄 aa.fit.rpt
字号:
; 2 ; 13 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 14 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 15 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 16 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 2 ; 17 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 1 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 2 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 3 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 4 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 5 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 6 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 7 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 8 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 9 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 10 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 11 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 12 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 13 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 14 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 15 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 16 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 3 ; 17 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 1 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 2 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 3 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 4 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 5 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 6 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 7 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 8 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 9 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 10 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 11 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 12 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 13 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 14 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 15 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 16 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; 4 ; 17 ; 80 ; 0 / 80 ( 0 % ) ; 0 / 160 ( 0 % ) ;
; Total ; ; 5440 ; 0 / 5440 ( 0 % ) ; 6 / 10880 ( < 1 % ) ;
+--------------+------+------------------------+-------------------+------------------------+
+-----------------------------------------------------------------------------+
; ESB Column Interconnect ;
+-------+------------------------+-------------------+------------------------+
; Col. ; Interconnect Available ; Interconnect Used ; Half Interconnect Used ;
+-------+------------------------+-------------------+------------------------+
; 0 ; 128 ; 0 / 128 ( 0 % ) ; 0 / 256 ( 0 % ) ;
; 1 ; 128 ; 0 / 128 ( 0 % ) ; 0 / 256 ( 0 % ) ;
; 2 ; 128 ; 0 / 128 ( 0 % ) ; 0 / 256 ( 0 % ) ;
; 3 ; 128 ; 0 / 128 ( 0 % ) ; 0 / 256 ( 0 % ) ;
; Total ; 512 ; 0 / 512 ( 0 % ) ; 0 / 1024 ( 0 % ) ;
+-------+------------------------+-------------------+------------------------+
+---------------------------------------------------------+
; Fitter Resource Usage Summary ;
+-----------------------------------+---------------------+
; Resource ; Usage ;
+-----------------------------------+---------------------+
; Registers ; 0 / 11,520 ( 0 % ) ;
; Logic elements in carry chains ; 0 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 14 / 152 ( 9 % ) ;
; -- Clock pins ; 0 / 4 ( 0 % ) ;
; -- Dedicated input pins ; 0 / 4 ( 0 % ) ;
; Global signals ; 0 ;
; ESBs ; 0 / 72 ( 0 % ) ;
; Macrocells ; 0 / 1,152 ( 0 % ) ;
; ESB pterm bits used ; 0 / 147,456 ( 0 % ) ;
; ESB CAM bits used ; 0 / 147,456 ( 0 % ) ;
; Total memory bits ; 0 / 147,456 ( 0 % ) ;
; Total RAM block bits ; 0 / 147,456 ( 0 % ) ;
; FastRow interconnects ; 0 / 120 ( 0 % ) ;
; Maximum fan-out node ; co[1]~151 ;
; Maximum fan-out ; 4 ;
; Highest non-global fan-out signal ; co[1]~151 ;
; Highest non-global fan-out ; 4 ;
; Total fan-out ; 41 ;
; Average fan-out ; 1.58 ;
+-----------------------------------+---------------------+
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+---------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Packed LCs ; Full Hierarchy Name ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+---------------------+
; |aa ; 12 (12) ; 0 ; 0 ; 14 ; 0 ; 12 (12) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |aa ;
+----------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+------------+---------------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+------------------------------------------------------------------------------------------------------------------+
; Delay Chain Summary ;
+-----------+----------+-------------+-----------------------+-------------------------+---------------------+-----+
; Name ; Pin Type ; Pad to Core ; Pad to Input Register ; Core to Output Register ; Core to CE Register ; TCO ;
+-----------+----------+-------------+-----------------------+-------------------------+---------------------+-----+
; cin ; Input ; ON ; OFF ; OFF ; OFF ; OFF ;
; b[0] ; Input ; ON ; OFF ; OFF ; OFF ; OFF ;
; a[0] ; Input ; ON ; OFF ; OFF ; OFF ; OFF ;
; b[1] ; Input ; ON ; OFF ; OFF ; OFF ; OFF ;
; a[1] ; Input ; ON ; OFF ; OFF ; OFF ; OFF ;
; b[2] ; Input ; ON ; OFF ; OFF ; OFF ; OFF ;
; a[2] ; Input ; ON ; OFF ; OFF ; OFF ; OFF ;
; b[3] ; Input ; ON ; OFF ; OFF ; OFF ; OFF ;
; a[3] ; Input ; ON ; OFF ; OFF ; OFF ; OFF ;
; bcdout[0] ; Output ; OFF ; OFF ; OFF ; OFF ; OFF ;
; bcdout[1] ; Output ; OFF ; OFF ; OFF ; OFF ; OFF ;
; bcdout[2] ; Output ; OFF ; OFF ; OFF ; OFF ; OFF ;
; bcdout[3] ; Output ; OFF ; OFF ; OFF ; OFF ; OFF ;
; cout ; Output ; OFF ; OFF ; OFF ; OFF ; OFF ;
+-----------+----------+-------------+-----------------------+-------------------------+---------------------+-----+
+-----------------------------+
; I/O Bank Usage ;
+----------+------------------+
; I/O Bank ; Usage ;
+----------+------------------+
; 1 ; 0 / 20 ( 0 % ) ;
; 2 ; 0 / 14 ( 0 % ) ;
; 3 ; 0 / 20 ( 0 % ) ;
; 4 ; 2 / 23 ( 9 % ) ;
; 5 ; 0 / 17 ( 0 % ) ;
; 6 ; 2 / 15 ( 13 % ) ;
; 7 ; 10 / 21 ( 48 % ) ;
; 8 ; 0 / 22 ( 0 % ) ;
+----------+------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/add_4/aa.pin.
+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
Info: Version 5.1 Build 176 10/26/2005 SJ Full Version
Info: Processing started: Mon May 05 10:01:06 2008
Info: Command: quartus_fit --read_settings_files=off --write_settings_files=off aa -c aa
Info: Selected device EP20K300EQC240-1 for design "aa"
Info: Timing requirements not specified -- optimizing circuit to achieve the following default global requirements
Info: Assuming a global fmax requirement of 1000 MHz
Info: Not setting a global tsu requirement
Info: Not setting a global tco requirement
Info: Not setting a global tpd requirement
Info: Started fitting attempt 1 on Mon May 05 2008 at 10:01:10
Warning: Performance of this circuit may degrade because the Fitter Delay Information is not⌨️ 快捷键说明
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