📄 seg7_1a.fit.rpt
字号:
; 16 ; 15 ; -- ; bb[1] ; output ; TTL ; ; Y ;
; 17 ; 16 ; -- ; bb[0] ; output ; TTL ; ; Y ;
; 18 ; 17 ; -- ; GND* ; ; ; ; ;
; 19 ; 18 ; -- ; GND ; gnd ; ; ; ;
; 20 ; 19 ; -- ; GND* ; ; ; ; ;
; 21 ; 20 ; -- ; GND* ; ; ; ; ;
; 22 ; 21 ; -- ; GND* ; ; ; ; ;
; 23 ; 22 ; -- ; +TMS ; input ; TTL ; ; N ;
; 24 ; 23 ; -- ; GND* ; ; ; ; ;
; 25 ; 24 ; -- ; aaa[3] ; output ; TTL ; ; Y ;
; 26 ; 25 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 27 ; 26 ; -- ; aaa[2] ; output ; TTL ; ; Y ;
; 28 ; 27 ; -- ; aaa[1] ; output ; TTL ; ; Y ;
; 29 ; 28 ; -- ; aaa[0] ; output ; TTL ; ; Y ;
; 30 ; 29 ; -- ; GND* ; ; ; ; ;
; 31 ; 30 ; -- ; GND* ; ; ; ; ;
; 32 ; 31 ; -- ; GND ; gnd ; ; ; ;
; 33 ; 32 ; -- ; GND* ; ; ; ; ;
; 34 ; 33 ; -- ; GND* ; ; ; ; ;
; 35 ; 34 ; -- ; cat[0] ; output ; TTL ; ; Y ;
; 36 ; 35 ; -- ; cat[1] ; output ; TTL ; ; Y ;
; 37 ; 36 ; -- ; cat[2] ; output ; TTL ; ; Y ;
; 38 ; 37 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 39 ; 38 ; -- ; cat[3] ; output ; TTL ; ; Y ;
; 40 ; 39 ; -- ; cat[4] ; output ; TTL ; ; Y ;
; 41 ; 40 ; -- ; cat[5] ; output ; TTL ; ; Y ;
; 42 ; 41 ; -- ; GND ; gnd ; ; ; ;
; 43 ; 42 ; -- ; VCCINT ; power ; ; 5.0V ; ;
; 44 ; 43 ; -- ; GND* ; ; ; ; ;
; 45 ; 44 ; -- ; GND* ; ; ; ; ;
; 46 ; 45 ; -- ; GND* ; ; ; ; ;
; 47 ; 46 ; -- ; GND ; gnd ; ; ; ;
; 48 ; 47 ; -- ; GND* ; ; ; ; ;
; 49 ; 48 ; -- ; GND* ; ; ; ; ;
; 50 ; 49 ; -- ; GND* ; ; ; ; ;
; 51 ; 50 ; -- ; GND* ; ; ; ; ;
; 52 ; 51 ; -- ; GND* ; ; ; ; ;
; 53 ; 52 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 54 ; 53 ; -- ; aa[3] ; input ; TTL ; ; Y ;
; 55 ; 54 ; -- ; aa[2] ; input ; TTL ; ; Y ;
; 56 ; 55 ; -- ; aa[1] ; input ; TTL ; ; Y ;
; 57 ; 56 ; -- ; aa[0] ; input ; TTL ; ; Y ;
; 58 ; 57 ; -- ; GND* ; ; ; ; ;
; 59 ; 58 ; -- ; GND ; gnd ; ; ; ;
; 60 ; 59 ; -- ; GND* ; ; ; ; ;
; 61 ; 60 ; -- ; GND* ; ; ; ; ;
; 62 ; 61 ; -- ; +TCK ; input ; TTL ; ; N ;
; 63 ; 62 ; -- ; GND* ; ; ; ; ;
; 64 ; 63 ; -- ; GND* ; ; ; ; ;
; 65 ; 64 ; -- ; GND* ; ; ; ; ;
; 66 ; 65 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 67 ; 66 ; -- ; GND* ; ; ; ; ;
; 68 ; 67 ; -- ; GND* ; ; ; ; ;
; 69 ; 68 ; -- ; GND* ; ; ; ; ;
; 70 ; 69 ; -- ; GND* ; ; ; ; ;
; 71 ; 70 ; -- ; *TDO ; output ; TTL ; ; N ;
; 72 ; 71 ; -- ; GND ; gnd ; ; ; ;
; 73 ; 72 ; -- ; GND* ; ; ; ; ;
; 74 ; 73 ; -- ; GND* ; ; ; ; ;
; 75 ; 74 ; -- ; GND* ; ; ; ; ;
; 76 ; 75 ; -- ; GND* ; ; ; ; ;
; 77 ; 76 ; -- ; GND* ; ; ; ; ;
; 78 ; 77 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 79 ; 78 ; -- ; GND* ; ; ; ; ;
; 80 ; 79 ; -- ; GND* ; ; ; ; ;
; 81 ; 80 ; -- ; GND* ; ; ; ; ;
; 82 ; 81 ; -- ; GND ; gnd ; ; ; ;
; 83 ; 82 ; -- ; GND+ ; ; ; ; ;
; 84 ; 83 ; -- ; GND+ ; ; ; ; ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
+-----------------------------------------------+
; Output Pin Load For Reported TCO ;
+--------------+-------+------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+--------------+-------+------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; TTL ; 0 pF ; Not Available ;
+--------------+-------+------------------------+
+----------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+------------+------+---------------------+
; Compilation Hierarchy Node ; Macrocells ; Pins ; Full Hierarchy Name ;
+----------------------------+------------+------+---------------------+
; |seg7_1a ; 17 ; 25 ; |seg7_1a ;
; |seg7_1:u1| ; 7 ; 0 ; |seg7_1a|seg7_1:u1 ;
+----------------------------+------------+------+---------------------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+---------------------+-----------+
; Name ; Fan-Out ;
+---------------------+-----------+
; aa[0] ; 8 ;
; aa[1] ; 8 ;
; aa[2] ; 8 ;
; aa[3] ; 8 ;
; ~GND~0 ; 1 ;
; ~VCC~4 ; 1 ;
; ~VCC~3 ; 1 ;
; ~VCC~2 ; 1 ;
; ~VCC~1 ; 1 ;
; ~VCC~0 ; 1 ;
; seg7_1:u1|b[3]~1007 ; 1 ;
; seg7_1:u1|b[6]~1001 ; 1 ;
; seg7_1:u1|b[5]~995 ; 1 ;
; seg7_1:u1|b[4]~989 ; 1 ;
; seg7_1:u1|b[0]~985 ; 1 ;
; seg7_1:u1|b[1]~979 ; 1 ;
; seg7_1:u1|b[2]~972 ; 1 ;
; aa[0]~34 ; 1 ;
; aa[1]~32 ; 1 ;
; aa[2]~30 ; 1 ;
; aa[3]~28 ; 1 ;
+---------------------+-----------+
+-----------------------------------------------+
; Interconnect Usage Summary ;
+----------------------------+------------------+
; Interconnect Resource Type ; Usage ;
+----------------------------+------------------+
; Output enables ; 0 / 6 ( 0 % ) ;
; PIA buffers ; 12 / 288 ( 4 % ) ;
; PIAs ; 12 / 288 ( 4 % ) ;
+----------------------------+------------------+
+----------------------------------------------------------------------------+
; LAB External Interconnect ;
+----------------------------------------------+-----------------------------+
; LAB External Interconnects (Average = 1.50) ; Number of LABs (Total = 3) ;
+----------------------------------------------+-----------------------------+
; 0 ; 5 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 3 ;
+----------------------------------------------+-----------------------------+
+----------------------------------------------------------------------+
; LAB Macrocells ;
+----------------------------------------+-----------------------------+
; Number of Macrocells (Average = 2.13) ; Number of LABs (Total = 4) ;
+----------------------------------------+-----------------------------+
; 0 ; 4 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 1 ;
; 4 ; 2 ;
; 5 ; 0 ;
; 6 ; 1 ;
+----------------------------------------+-----------------------------+
+--------------------------------------------------------+
; Logic Cell Interconnection ;
+-----+------------+----------------------------+--------+
; LAB ; Logic Cell ; Input ; Output ;
+-----+------------+----------------------------+--------+
; A ; LC3 ; aa[2], aa[3], aa[0], aa[1] ; bb[3] ;
; A ; LC8 ; aa[0], aa[1], aa[2], aa[3] ; bb[6] ;
; A ; LC6 ; aa[3], aa[1], aa[2], aa[0] ; bb[5] ;
; A ; LC5 ; aa[0], aa[1], aa[2], aa[3] ; bb[4] ;
; B ; LC29 ; aa[3], aa[1], aa[2], aa[0] ; bb[2] ;
; B ; LC27 ; aa[3], aa[2], aa[0], aa[1] ; bb[1] ;
; B ; LC25 ; aa[0], aa[2], aa[3], aa[1] ; bb[0] ;
; C ; LC38 ; aa[0] ; aaa[0] ;
; C ; LC40 ; aa[1] ; aaa[1] ;
; C ; LC43 ; aa[2] ; aaa[2] ;
; C ; LC45 ; aa[3] ; aaa[3] ;
; D ; LC49 ; ; cat[5] ;
; D ; LC51 ; ; cat[4] ;
; D ; LC53 ; ; cat[3] ;
; D ; LC56 ; ; cat[2] ;
; D ; LC57 ; ; cat[1] ;
; D ; LC59 ; ; cat[0] ;
+-----+------------+----------------------------+--------+
+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
Info: Version 4.1 Build 181 06/29/2004 SJ Full Version
Info: Processing started: Mon Apr 10 11:13:01 2006
Info: Command: quartus_fit --import_settings_files=off --export_settings_files=off seg7_1a -c seg7_1a
Info: Selected device EPM7128SLC84-15 for design seg7_1a
Info: Quartus II Fitter was successful. 0 errors, 0 warnings
Info: Processing ended: Mon Apr 10 11:13:01 2006
Info: Elapsed time: 00:00:00
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