📄 sd_top.fit.rpt
字号:
+-------------+-------+---------+--------+
; ch_rw ; 54 ; 1 ; no ;
; clk ; 55 ; 74 ; yes ;
; ch_req ; 124 ; 2 ; no ;
; rst_l ; 126 ; 49 ; yes ;
; ch_addr[19] ; 56 ; 1 ; no ;
; ch_addr[20] ; 125 ; 1 ; no ;
+-------------+-------+---------+--------+
+---------------------------------------------+
; Carry Chains ;
+--------------------+------------------------+
; Carry Chain Length ; Number of Carry Chains ;
+--------------------+------------------------+
; 0 ; 0 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 0 ;
; 7 ; 0 ;
; 8 ; 1 ;
; 9 ; 0 ;
; 10 ; 0 ;
; 11 ; 1 ;
+--------------------+------------------------+
+----------------+
; Cascade Chains ;
+--------+-------+
; Length ; Count ;
+--------+-------+
; 2 ; 3 ;
+--------+-------+
+-----------------------------------------------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals ;
+-------------------------------------------------------------------------------------------------------------+---------+
; Name ; Fan-Out ;
+-------------------------------------------------------------------------------------------------------------+---------+
; sd_top:sd_top1|sd_state:u2|sdram_cycle[1]~190 ; 26 ;
; sd_top:sd_top1|sd_state:u2|sdram_cycle[2]~187 ; 22 ;
; sd_top:sd_top1|sd_sig:u4|state_cntr[0]~51 ; 17 ;
; sd_top:sd_top1|sd_state:u2|sdram_cycle[3]~189 ; 16 ;
; sd_top:sd_top1|sd_state:u2|sdram_cycle[0]~191 ; 13 ;
; sd_top:sd_top1|sd_state:u2|sdram_cycle[4]~188 ; 12 ;
; sd_top:sd_top1|sd_state:u2|sdram_cycle[3]~$wirecell ; 11 ;
; rw_sd_mach:u1|dp_rden~8 ; 9 ;
; sd_top:sd_top1|sd_cnfg:u1|state.idle~27 ; 9 ;
; sd_top:sd_top1|sd_cnfg:u1|sdram_en2~3 ; 6 ;
; sd_top:sd_top1|sd_cnfg:u1|sdram_setup~10 ; 4 ;
; sd_top:sd_top1|sd_sig:u4|state_cntr[3]~52 ; 4 ;
; sd_top:sd_top1|sd_cnfg:u1|state.refresh2~15 ; 4 ;
; sd_top:sd_top1|sd_cnfg:u1|state.refresh1~15 ; 4 ;
; sd_top:sd_top1|sd_cnfg:u1|load_req~7 ; 4 ;
; sd_top:sd_top1|sd_state:u2|charge_on~12 ; 4 ;
; sd_top:sd_top1|sd_cnfg:u1|state.precharge~13 ; 4 ;
; sd_top:sd_top1|sd_cnfg:u1|fresh_req~18 ; 4 ;
; sd_top:sd_top1|sd_state:u2|sdram_cycle[4]~192 ; 4 ;
; sd_top:sd_top1|sd_cnfg:u1|charge_req~15 ; 4 ;
; sd_top:sd_top1|sd_cnfg:u1|state.load_mode~13 ; 4 ;
; sd_top:sd_top1|sd_state:u2|Selector5~190 ; 3 ;
; sd_top:sd_top1|sd_state:u2|Selector2~115 ; 3 ;
; sd_top:sd_top1|sd_rfrsh:u3|fresh_req~111 ; 3 ;
; rw_sd_mach:u1|lpm_counter:dp_addr_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[2]~COUT ; 2 ;
; rw_sd_mach:u1|lpm_counter:dp_addr_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[6]~COUT ; 2 ;
; sd_top:sd_top1|sd_cnfg:u1|state.nop2~17 ; 2 ;
; rw_sd_mach:u1|lpm_counter:dp_addr_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[5]~COUT ; 2 ;
; sd_top:sd_top1|sd_cnfg:u1|state.all_done~17 ; 2 ;
; rw_sd_mach:u1|lpm_counter:dp_addr_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[4]~COUT ; 2 ;
; sd_top:sd_top1|sd_rfrsh:u3|lpm_counter:rfrsh_cntr_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[4]~COUT ; 2 ;
; sd_top:sd_top1|sd_state:u2|Selector2~114 ; 2 ;
; rw_sd_mach:u1|data_req~17 ; 2 ;
; ch_req ; 2 ;
; rw_sd_mach:u1|lpm_counter:dp_addr_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[0]~COUT ; 2 ;
; rw_sd_mach:u1|lpm_counter:dp_addr_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[3]~COUT ; 2 ;
; sd_top:sd_top1|sd_rfrsh:u3|lpm_counter:rfrsh_cntr_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[0]~COUT ; 2 ;
; sd_top:sd_top1|sd_rfrsh:u3|lpm_counter:rfrsh_cntr_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[1]~COUT ; 2 ;
; sd_top:sd_top1|sd_rfrsh:u3|lpm_counter:rfrsh_cntr_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[3]~COUT ; 2 ;
; sd_top:sd_top1|sd_rfrsh:u3|lpm_counter:rfrsh_cntr_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[2]~COUT ; 2 ;
; rw_sd_mach:u1|lpm_counter:dp_addr_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[1]~COUT ; 2 ;
; sd_top:sd_top1|sd_rfrsh:u3|lpm_counter:rfrsh_cntr_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[6]~COUT ; 2 ;
; sd_top:sd_top1|sd_rfrsh:u3|lpm_counter:rfrsh_cntr_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[5]~COUT ; 2 ;
; sd_top:sd_top1|sd_rfrsh:u3|lpm_counter:rfrsh_cntr_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[9]~COUT ; 2 ;
; sd_top:sd_top1|sd_rfrsh:u3|lpm_counter:rfrsh_cntr_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[8]~COUT ; 2 ;
; sd_top:sd_top1|sd_rfrsh:u3|lpm_counter:rfrsh_cntr_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[7]~COUT ; 2 ;
; rw_sd_mach:u1|add[19]~48 ; 1 ;
; sd_top:sd_top1|sd_cnfg:u1|Selector7~140 ; 1 ;
; sd_top:sd_top1|sd_state:u2|Selector1~140 ; 1 ;
; sd_top:sd_top1|sd_state:u2|Selector0~137 ; 1 ;
+-------------------------------------------------------------------------------------------------------------+---------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 50 ;
; 1 ; 9 ;
; 2 ; 1 ;
; 3 ; 0 ;
; 4 ; 1 ;
; 5 ; 0 ;
; 6 ; 0 ;
; 7 ; 2 ;
; 8 ; 9 ;
+--------------------------+----------------+
+----------------------------------------------+
; Local Routing Interconnect ;
+-----------------------------+----------------+
; Local Routing Interconnects ; Number of LABs ;
+-----------------------------+----------------+
; 0 ; 60 ;
; 1 ; 2 ;
; 2 ; 1 ;
; 3 ; 2 ;
; 4 ; 1 ;
; 5 ; 2 ;
; 6 ; 2 ;
; 7 ; 2 ;
+-----------------------------+----------------+
+---------------------------------------------+
; LAB External Interconnect ;
+----------------------------+----------------+
; LAB External Interconnects ; Number of LABs ;
+----------------------------+----------------+
; 0 ; 51 ;
; 1 ; 12 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 2 ;
; 5 ; 0 ;
; 6 ; 0 ;
; 7 ; 2 ;
; 8 ; 1 ;
; 9 ; 4 ;
+----------------------------+----------------+
+----------------------------------------------------------------------------------------+
; Row Interconnect ;
+-------+-------------------+-----------------------------+------------------------------+
; Row ; Interconnect Used ; Left Half Interconnect Used ; Right Half Interconnect Used ;
+-------+-------------------+-----------------------------+------------------------------+
; A ; 1 / 96 ( 1 % ) ; 0 / 48 ( 0 % ) ; 8 / 48 ( 17 % ) ;
; B ; 3 / 96 ( 3 % ) ; 1 / 48 ( 2 % ) ; 0 / 48 ( 0 % ) ;
; C ; 8 / 96 ( 8 % ) ; 13 / 48 ( 27 % ) ; 37 / 48 ( 77 % ) ;
; Total ; 12 / 288 ( 4 % ) ; 14 / 144 ( 10 % ) ; 45 / 144 ( 31 % ) ;
+-------+-------------------+-----------------------------+------------------------------+
+---------------------------+
; LAB Column Interconnect ;
+-------+-------------------+
; Col. ; Interconnect Used ;
+-------+-------------------+
; 1 ; 0 / 24 ( 0 % ) ;
; 2 ; 2 / 24 ( 8 % ) ;
; 3 ; 2 / 24 ( 8 % ) ;
; 4 ; 2 / 24 ( 8 % ) ;
; 5 ; 0 / 24 ( 0 % ) ;
; 6 ; 0 / 24 ( 0 % ) ;
; 7 ; 0 / 24 ( 0 % ) ;
; 8 ; 1 / 24 ( 4 % ) ;
; 9 ; 1 / 24 ( 4 % ) ;
; 10 ; 0 / 24 ( 0 % ) ;
; 11 ; 0 / 24 ( 0 % ) ;
; 12 ; 0 / 24 ( 0 % ) ;
; 13 ; 1 / 24 ( 4 % ) ;
; 14 ; 2 / 24 ( 8 % ) ;
; 15 ; 1 / 24 ( 4 % ) ;
; 16 ; 0 / 24 ( 0 % ) ;
; 17 ; 1 / 24 ( 4 % ) ;
; 18 ; 1 / 24 ( 4 % ) ;
; 19 ; 1 / 24 ( 4 % ) ;
; 20 ; 0 / 24 ( 0 % ) ;
; 21 ; 1 / 24 ( 4 % ) ;
; 22 ; 1 / 24 ( 4 % ) ;
; 23 ; 0 / 24 ( 0 % ) ;
; 24 ; 0 / 24 ( 0 % ) ;
; Total ; 17 / 576 ( 3 % ) ;
+-------+-------------------+
+---------------------------+
; LAB Column Interconnect ;
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