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📄 piso.map.rpt

📁 FPGA数字移相器,编程环境为QUIRTE2,编程语言采用硬件描述语言vhdl
💻 RPT
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; Analysis & Synthesis Resource Utilization by Entity                                                                                                                                                                                                                                                                                                                                             ;
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; Compilation Hierarchy Node                                             ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name                                                                                                                                                           ;
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;       |sld_dffex:IRF_ENA|                                              ; 2 (2)       ; 2            ; 0           ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 2 (2)            ; 0 (0)           ; |top|sld_hub:sld_hub_inst|sld_dffex:IRF_ENA                                                                                                                                   ;
;       |sld_dffex:IRSR|                                                 ; 7 (7)       ; 7            ; 0           ; 0    ; 0            ; 0 (0)        ; 2 (2)             ; 5 (5)            ; 0 (0)           ; |top|sld_hub:sld_hub_inst|sld_dffex:IRSR                                                                                                                                      ;
;       |sld_dffex:RESET|                                                ; 1 (1)       ; 1            ; 0           ; 0    ; 0            ; 0 (0)        ; 1 (1)             ; 0 (0)            ; 0 (0)           ; |top|sld_hub:sld_hub_inst|sld_dffex:RESET                                                                                                                                     ;
;       |sld_dffex:\GEN_IRF:1:IRF|                                       ; 5 (5)       ; 5            ; 0           ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 5 (5)            ; 0 (0)           ; |top|sld_hub:sld_hub_inst|sld_dffex:\GEN_IRF:1:IRF                                                                                                                            ;
;       |sld_dffex:\GEN_IRF:2:IRF|                                       ; 5 (5)       ; 5            ; 0           ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 5 (5)            ; 0 (0)           ; |top|sld_hub:sld_hub_inst|sld_dffex:\GEN_IRF:2:IRF                                                                                                                            ;
;       |sld_dffex:\GEN_SHADOW_IRF:1:S_IRF|                              ; 5 (5)       ; 5            ; 0           ; 0    ; 0            ; 0 (0)        ; 5 (5)             ; 0 (0)            ; 0 (0)           ; |top|sld_hub:sld_hub_inst|sld_dffex:\GEN_SHADOW_IRF:1:S_IRF                                                                                                                   ;
;       |sld_dffex:\GEN_SHADOW_IRF:2:S_IRF|                              ; 5 (5)       ; 5            ; 0           ; 0    ; 0            ; 0 (0)        ; 5 (5)             ; 0 (0)            ; 0 (0)           ; |top|sld_hub:sld_hub_inst|sld_dffex:\GEN_SHADOW_IRF:2:S_IRF                                                                                                                   ;
;       |sld_jtag_state_machine:jtag_state_machine|                      ; 21 (21)     ; 19           ; 0           ; 0    ; 0            ; 2 (2)        ; 0 (0)             ; 19 (19)          ; 0 (0)           ; |top|sld_hub:sld_hub_inst|sld_jtag_state_machine:jtag_state_machine                                                                                                           ;
;       |sld_rom_sr:HUB_INFO_REG|                                        ; 19 (19)     ; 9            ; 0           ; 0    ; 0            ; 10 (10)      ; 2 (2)             ; 7 (7)            ; 5 (5)           ; |top|sld_hub:sld_hub_inst|sld_rom_sr:HUB_INFO_REG                                                                                                                             ;
+------------------------------------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+


+--------------------------------+
; Analysis & Synthesis Equations ;
+--------------------------------+
The equations can be found in G:/EDA/piso/piso.map.eqn.


+-------------------------------------------------------------------------------------+
; Analysis & Synthesis Source Files Read                                              ;
+-------------------------------------------------------------------+-----------------+
; File Name                                                         ; Used in Netlist ;
+-------------------------------------------------------------------+-----------------+
; sin_rom.vhd                                                       ; yes             ;
; piso.vhd                                                          ; yes             ;
; pf.vhd                                                            ; yes             ;
; top.vhd                                                           ; yes             ;
; add.vhd                                                           ; yes             ;
; e:/altera/quartus41/libraries/megafunctions/altsyncram.tdf        ; yes             ;
; e:/altera/quartus41/libraries/megafunctions/stratix_ram_block.inc ; yes             ;
; G:/EDA/piso/db/altsyncram_qjs.tdf                                 ; yes             ;
; G:/EDA/piso/db/altsyncram_gaa2.tdf                                ; yes             ;
; e:/altera/quartus41/libraries/megafunctions/sld_mod_ram_rom.vhd   ; yes             ;
; e:/altera/quartus41/libraries/megafunctions/sld_rom_sr.vhd        ; yes             ;
; e:/altera/quartus41/libraries/megafunctions/sld_hub.vhd           ; yes             ;
; e:/altera/quartus41/libraries/megafunctions/lpm_shiftreg.tdf      ; yes             ;
; e:/altera/quartus41/libraries/megafunctions/lpm_constant.inc      ; yes             ;
; e:/altera/quartus41/libraries/megafunctions/lpm_decode.tdf        ; yes             ;
; e:/altera/quartus41/libraries/megafunctions/declut.inc            ; yes             ;
; G:/EDA/piso/db/decode_9ie.tdf                                     ; yes             ;
; e:/altera/quartus41/libraries/megafunctions/sld_dffex.vhd         ; yes             ;
; e:/altera/quartus41/libraries/megafunctions/lpm_counter.tdf       ; yes             ;
; G:/EDA/piso/db/cntr_fa7.tdf                                       ; yes             ;
; G:/EDA/piso/db/cntr_0a8.tdf                                       ; yes             ;
; G:/EDA/piso/db/cntr_pd8.tdf                                       ; yes             ;
+-------------------------------------------------------------------+-----------------+


+--------------------------------------------------------------+
; Analysis & Synthesis Resource Usage Summary                  ;
+-----------------------------------+--------------------------+
; Resource                          ; Usage                    ;
+-----------------------------------+--------------------------+
; Logic cells                       ; 471                      ;
; Total combinational functions     ; 336                      ;
; Total 4-input functions           ; 116                      ;
; Total 3-input functions           ; 97                       ;
; Total 2-input functions           ; 53                       ;
; Total 1-input functions           ; 69                       ;
; Total 0-input functions           ; 1                        ;
; Combinational cells for routing   ; 0                        ;
; Total registers                   ; 269                      ;
; Total logic cells in carry chains ; 84                       ;
; I/O pins                          ; 30                       ;
; Total memory bits                 ; 8192                     ;
; Maximum fan-out node              ; altera_internal_jtag~TDO ;
; Maximum fan-out                   ; 177                      ;

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