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基于VHDL语言的32位单精度的浮点加法器

VHDL/FPGA/Verilog 10 K 153 次下载 2017-09-09

资源详细信息

文件格式

RAR

文件大小

10 K

资源分类

VHDL/FPGA/Verilog

上传者

发布时间

2017-09-09 00:27

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153 次

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2 积分

基于VHDL语言的32位单精度的浮点加法器 - 资源详细说明

基于VHDL语言的32位单精度的浮点加法器

基于VHDL语言的32位单精度的浮点加法器 - 源码文件列表

本资源包含 14 个源码文件支持在线预览，点击文件名即可查看

1

barrell.vhd

2

full_adder.vhd

3

manmux.vhd

4

ext_32to25.vhd

5

ext2_32to25.vhd

6

barrelr.vhd

7

ext2_25to32.vhd

8

manadd.vhd

9

ext_25to32.vhd

10

leadsign.vhd

11

adjust.vhd

12

expcomp.vhd

13

fadd.vhd

14

fadd.bdf

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