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VHDL/FPGA/Verilog
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采用FPGA控制LCD。程序中用了两个状态机
采用FPGA控制LCD。程序中用了两个状态机
VHDL/FPGA/Verilog
985 K
100 次下载
2013-12-18
资源详细信息
文件格式
RAR
文件大小
985 K
资源分类
VHDL/FPGA/Verilog
上传者
LotusAwhaT
发布时间
2013-12-18 17:16
下载统计
100
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采用FPGA控制LCD。程序中用了两个状态机 - 资源详细说明
采用FPGA控制LCD。程序中用了两个状态机
采用FPGA控制LCD。程序中用了两个状态机 - 源码文件列表
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1
ctl_lcd.pin
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2
ctl_lcd.fit.rpt
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3
fen50.bsf
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4
ctl_lcd.bdf
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5
lcd.bsf
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6
ctl_lcd.tan.summary
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7
fen50.v.bak
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8
ctl_lcd.asm.rpt
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9
ctl_lcd.qpf
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10
lpm_rom0_wave0.jpg
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11
lpm_rom0_bb.v
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12
ctl_lcd.map.summary
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13
lpm_rom0.bsf
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14
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15
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