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资源详细信息
实现开漏输出的并口 - 资源详细说明
实现开漏输出的并口，支持3.3V或5V，支持FPGA 的PS 配置功能。8位配置数据
自动移位输出，输入时钟24MHz，产生1MHz配置时钟。8位CPU数据总线接口，
11位地址总线。支持IO 的置位清除功能。
实现开漏输出的并口 - 源码文件列表
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