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源码工程 VHDL/FPGA/Verilog 人工审核无毒

利用fpga读写ddr的源代码 实测可以使用

所属分类 VHDL/FPGA/Verilog
文件大小 464 K
文件格式 RAR 文件
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资料详细技术说明

利用fpga读写ddr的源代码 实测可以使用

压缩包内文件清单（共 12 个文件）

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1 FILE
mem_interface_top_rd_data_0.txt 19 KB
包内组件
2 FILE
mem_interface_top_ddr_controller_0.txt 53.3 KB
包内组件
3 FILE
mem_interface_top_data_path_0.txt 3.8 KB
包内组件
4 FILE
mem_interface_top_v4_dqs_iob.txt 2.6 KB
包内组件
5 FILE
mem_interface_top_rd_data_fifo_0.txt 6.5 KB
包内组件
6 FILE
mem_interface_top_infrastructure_iobs_0.txt 4.5 KB
包内组件
7 FILE
mem_interface_top_main_0.txt 5 KB
包内组件
8 FILE
mem_interface_top_v4_dm_iob.txt 1.5 KB
包内组件
9 FILE
mem_interface_top_pattern_compare8.txt 6.3 KB
包内组件
10 FILE
mem_interface_top_data_tap_inc.txt 3.9 KB
包内组件
11 FILE
mem_interface_top_backend_rom_0.txt 5.6 KB
包内组件
12 FILE
mem_interface_top_rd_wr_addr_fifo_0.txt 4.2 KB
包内组件

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