任意时钟配比的异步fifo.含有synplify ip库中的双端口ram。用于处理多时钟域问题。 - 免费下载

VHDL/FPGA/Verilog资源文件大小：6 K

📋 资源详细信息

文件格式

RAR

所属分类

VHDL/FPGA/Verilog

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上传时间

2014-12-04 12:45

文件大小

6 K

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资源简介

任意时钟配比的异步fifo.含有synplify ip库中的双端口ram。用于处理多时钟域问题。

源码文件列表

📂 共 3 个源码文件点击文件名可在线查看源代码

1 📄

fifowrclkram.v

大小: 2.85 KB

2 📄

syncore_ram.v

大小: 6.78 KB

3 📄

asyncfifoxpx.v

大小: 7.72 KB

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#synplify #fifo #ram #时钟

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