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RS232 verilog coding 全参数化设计可以自己设定波特率时钟频率等完全FPGA实现调通

VHDL/FPGA/Verilog 3 K 86 次下载 2016-12-28

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RAR

文件大小

3 K

资源分类

VHDL/FPGA/Verilog

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发布时间

2016-12-28 20:35

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RS232 verilog coding 全参数化设计可以自己设定波特率时钟频率等完全FPGA实现调通 - 资源详细说明

RS232 verilog coding 全参数化设计可以自己设定波特率时钟频率等完全FPGA实现调通

RS232 verilog coding 全参数化设计可以自己设定波特率时钟频率等完全FPGA实现调通 - 源码文件列表

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