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7段数码显示译码器设计7段数码是纯组合电路
7段数码显示译码器设计7段数码是纯组合电路
VHDL/FPGA/Verilog
82 K
144 次下载
2014-01-26
资源详细信息
文件格式
RAR
文件大小
82 K
资源分类
VHDL/FPGA/Verilog
上传者
rain0413
发布时间
2014-01-26 12:11
下载统计
144
次
所需积分
2 积分
7段数码显示译码器设计7段数码是纯组合电路 - 资源详细说明
7段数码显示译码器设计7段数码是纯组合电路,通常的小规模专用IC,如74或4000系列的器件只能作十进制BCD码译码,然而数字系统中的数据处理和运算都是二进制的,所以输出表达都是十六进制的,为了满足十六进制数的译码显示,最方便的方法就是利用译码程序在FPGA/CPLD中来实现。例子作为七段译码器,输出信号LED7S的7位分别接数码管的7个段,高位在左,低位在右。例如当LED7S输出为“1101101”时,数码管的7个段g、f、e、d、c、b、a分别接1、1、0、1、1、0、1;接有高电平的段发亮,于是数码管显示“5”。
7段数码显示译码器设计7段数码是纯组合电路 - 源码文件列表
本资源包含 61 个源码文件
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1
declcnt.hif
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2
decl7s.rpt
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3
cnt16(2).cnf
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4
u8030602.dls
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5
declcnt(7).cnf
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6
decl7s.ndb
查看源码
7
declcnt.pof
查看源码
8
cnt16(1).cnf
查看源码
9
u2810419.dls
查看源码
10
cnt16.fit
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11
declcnt.mmf
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12
decl7s.sym
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13
lib.dls
查看源码
14
cnt16(5).cnf
查看源码
15
decl7s.pof
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