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VHDL/FPGA/Verilog资源文件大小：4962 K

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VHDL/FPGA/Verilog

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guo25621286

上传时间

2016-09-02 00:03

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基于spartan3e的LCD显示程序,可直接将其bit文件烧写到spartan3e里面即可使用

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📂 共 140 个源码文件点击文件名可在线查看源代码

1 📄

s3esk_lcd_v2_1_0.mdd

大小: 984 B

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2 📄

s3esk_lcd_v2_1_0.tcl

大小: 581 B

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3 📄

makefile

大小: 866 B

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4 📋

s3esk_lcd.h

大小: 8.19 KB

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5 📄

s3esk_lcd_selftest.c

大小: 4.45 KB

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6 📄

s3esk_lcd.c

大小: 2.15 KB

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7 📄

makefile

大小: 464 B

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8 📄

xgpio.c

大小: 8.11 KB

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9 📋

xgpio.h

大小: 6.64 KB

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10 📋

xgpio_i.h

大小: 2.42 KB

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11 📄

xgpio_intr.c

大小: 10.27 KB

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12 📋

xgpio_l.h

大小: 8.59 KB

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13 📄

xgpio_extra.c

大小: 5.05 KB

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14 📄

xgpio_sinit.c

大小: 4.52 KB

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15 📄

xgpio_selftest.c

大小: 3.63 KB

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