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VHDL数字控制系统设计代码 ALARM_SET,BCD_ADD等53个实例

VHDL/FPGA/Verilog 47 K 123 次下载 2016-06-20

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RAR

文件大小

47 K

资源分类

VHDL/FPGA/Verilog

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发布时间

2016-06-20 20:11

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VHDL数字控制系统设计代码 ALARM_SET,BCD_ADD等53个实例 - 资源详细说明

VHDL数字控制系统设计代码 ALARM_SET,BCD_ADD等53个实例，非常适合初学者学习参考

VHDL数字控制系统设计代码 ALARM_SET,BCD_ADD等53个实例 - 源码文件列表

本资源包含 58 个源码文件支持在线预览，点击文件名即可查看

1

i24bcd.vhd

2

s95.log

3

scan8.vhd

4

count_down.vhd

5

cola.er

6

i60bcd.vhd

7

scan_gen.vhd

8

stop_watch.vhd

9

alarm_set.vhd

10

traffic_fsm.vhd

11

hex_font.vhd

12

my_package.vhd

13

my_pkg.vhd

14

fadd4.vhd

15

regne.vhd

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