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VHDL/FPGA/Verilog
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此代码用于产生系统设计仿真阶段需要的仿真数据
此代码用于产生系统设计仿真阶段需要的仿真数据
VHDL/FPGA/Verilog
36 K
70 次下载
2013-12-21
资源详细信息
文件格式
RAR
文件大小
36 K
资源分类
VHDL/FPGA/Verilog
上传者
jianmingcao
发布时间
2013-12-21 04:37
下载统计
70
次
所需积分
2 积分
此代码用于产生系统设计仿真阶段需要的仿真数据 - 资源详细说明
此代码用于产生系统设计仿真阶段需要的仿真数据,运行的结果是一系列随机数。编译后可生成数据产生模块,在其他工程中之间调用之作为数据输入即可,对vhdl涉及仿真有一定的帮助
此代码用于产生系统设计仿真阶段需要的仿真数据 - 源码文件列表
本资源包含 6 个源码文件
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1
math_lib.vhd
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2
rng_lib.vhd
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3
tb_rng.vhd
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readme.txt
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