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VHDL/FPGA/Verilog
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这是一个实现时分秒的时钟功能的源码
这是一个实现时分秒的时钟功能的源码
VHDL/FPGA/Verilog
242 K
126 次下载
2016-04-28
资源详细信息
文件格式
RAR
文件大小
242 K
资源分类
VHDL/FPGA/Verilog
上传者
wp1111111
发布时间
2016-04-28 20:39
下载统计
126
次
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这是一个实现时分秒的时钟功能的源码 - 资源详细说明
这是一个实现时分秒的时钟功能的源码,采用vhdl语言编写,已写好led驱动,可直接在数码管上显示
这是一个实现时分秒的时钟功能的源码 - 源码文件列表
本资源包含 81 个源码文件
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1
counter24.bsf
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2
clock.map.rpt
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3
waveform1.vwf
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4
install.ptf
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5
counter10.bsf
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6
clock.fit.eqn
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7
clock.map.eqn
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8
counter6.bsf
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9
waveform3.vwf
查看源码
10
clock.vwf
查看源码
11
clock.asm.rpt
查看源码
12
clock.bsf
查看源码
13
decoder.bsf
查看源码
14
clock.fit.rpt
查看源码
15
waveform2.vwf
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