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VHDL/FPGA/Verilog资源文件大小：759 K

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VHDL/FPGA/Verilog

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wuqunzhen

上传时间

2016-04-12 20:35

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详细介绍了ALTERA器件的IP CORE以及如何使用SDR SDRAM CONTROL

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1 📃

readme_sdr_sdram.txt

大小: 319 B

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2 📄

sdr_sdram_tb.v

大小: 21.92 KB

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3 📃

bbs.eetzone.com.txt

大小: 620 B

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4 📄

control_interface.v

大小: 8.26 KB

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5 📄

sdr_sdram.v

大小: 6.78 KB

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6 📄

params.v

大小: 935 B

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7 📄

sdr_data_path.v

大小: 2.68 KB

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8 📄

compile_all.v

大小: 206 B

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9 📄

command.v

大小: 16.92 KB

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10 📄

altclklock.v

大小: 8.34 KB

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11 📄

pll1.v

大小: 4.64 KB

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12 📄

sdr_sdram.pdf

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