王金明：《Verilog HDL 程序设计教程》程序 把程序部分单独列出来 让你跳过大段文字直接接触源程序 - 免费下载

VHDL/FPGA/Verilog资源 文件大小：172 K

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文件格式
RAR
所属分类
VHDL/FPGA/Verilog
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资源简介

王金明：《Verilog HDL 程序设计教程》程序 把程序部分单独列出来 让你跳过大段文字直接接触源程序

源码文件列表

📂 共 152 个源码文件 点击文件名可在线查看源代码

1 📄
map_lpm_ram.v
大小: 440 B
查看源码
2 📄
shifter.v
大小: 225 B
查看源码
3 📄
decoder_38.v
大小: 331 B
查看源码
4 📄
mac.v
大小: 486 B
查看源码
5 📄
mac_tp.v
大小: 641 B
查看源码
6 📄
mux_if.v
大小: 289 B
查看源码
7 📄
dff2.v
大小: 282 B
查看源码
8 📄
dff1.v
大小: 318 B
查看源码
9 📄
latch_2.v
大小: 133 B
查看源码
10 📄
johnson.v
大小: 227 B
查看源码
11 📄
jk_ff.v
大小: 334 B
查看源码
12 📄
dff.v
大小: 110 B
查看源码
13 📄
tri_2.v
大小: 93 B
查看源码
14 📄
mpc.v
大小: 668 B
查看源码
15 📄
latch_1.v
大小: 87 B
查看源码
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