网上流传的usb_blaster原理图里的CPLD源码,主要是实现usb时序转换成JATG时序输出！ - 免费下载

VHDL/FPGA/Verilog资源文件大小：52 K

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RAR

所属分类

VHDL/FPGA/Verilog

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dragoncircle

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2014-06-05 04:59

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网上流传的usb_blaster原理图里的CPLD源码,主要是实现usb时序转换成JATG时序输出！

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1 📄

makefile

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2 📄

eecksum.c

大小: 376 B

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3 📄

makefile

大小: 144 B

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4 📄

devtest.c

大小: 2.96 KB

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5 📄

usb_jtag.patch

大小: 22.6 KB

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6 📄

read_idcode

大小: 75 B

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7 📄

openocd.cfg

大小: 117 B

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8 📄

usb_jtag.patch

大小: 23.78 KB

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9 📄

dscr.a51

大小: 7.48 KB

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10 📄

usbjtag.c

大小: 17.69 KB

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11 📄

usbjtag.uv2

大小: 2.3 KB

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fw.c

大小: 12.6 KB

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usbjtag.opt

大小: 1.32 KB

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eeprom.c

大小: 2.45 KB

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15 📄

shift.a51

大小: 3.17 KB

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