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VHDL/FPGA/Verilog
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7段数码显示译码器设计
7段数码显示译码器设计
VHDL/FPGA/Verilog
8 K
161 次下载
2013-12-18
资源详细信息
文件格式
RAR
文件大小
8 K
资源分类
VHDL/FPGA/Verilog
上传者
wc7707399
发布时间
2013-12-18 20:24
下载统计
161
次
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2 积分
7段数码显示译码器设计 - 资源详细说明
7段数码显示译码器设计,包裹程序设计,实验目的,内容,图像。
7段数码显示译码器设计 - 源码文件列表
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