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VHDL/FPGA/Verilog
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基于CPLD的签到器的设计
基于CPLD的签到器的设计
VHDL/FPGA/Verilog
5389 K
53 次下载
2014-01-14
资源详细信息
文件格式
ZIP
文件大小
5389 K
资源分类
VHDL/FPGA/Verilog
上传者
hqbbsw
发布时间
2014-01-14 21:33
下载统计
53
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yima.hif
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prev_cmp_yima.fit.qmsg
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9
yima.hier_info
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10
speaker.hif
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11
prev_cmp_speaker.map.qmsg
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12
speaker.map.logdb
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13
speaker.hier_info
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14
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查看源码
15
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