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这是一个数字钟的VHDL实现.采用八段数码管显示! --可
这是一个数字钟的VHDL实现.采用八段数码管显示! --可调闹铃
VHDL/FPGA/Verilog
6 K
25 次下载
2013-12-27
资源详细信息
文件格式
RAR
文件大小
6 K
资源分类
VHDL/FPGA/Verilog
上传者
lemon_zc1949
发布时间
2013-12-27 00:48
下载统计
25
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2 积分
这是一个数字钟的VHDL实现.采用八段数码管显示! --可调闹铃 - 资源详细说明
这是一个数字钟的VHDL实现.采用八段数码管显示! --可调闹铃,可校时。
这是一个数字钟的VHDL实现.采用八段数码管显示! --可调闹铃 - 源码文件列表
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1
digital clock.vhd
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