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本代码用于在两个数据报文之间插入一个周期的时钟间隔
本代码用于在两个数据报文之间插入一个周期的时钟间隔
VHDL/FPGA/Verilog
2 K
94 次下载
2013-12-19
资源详细信息
文件格式
RAR
文件大小
2 K
资源分类
VHDL/FPGA/Verilog
上传者
janeljh1
发布时间
2013-12-19 15:41
下载统计
94
次
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2 积分
本代码用于在两个数据报文之间插入一个周期的时钟间隔 - 资源详细说明
本代码用于在两个数据报文之间插入一个周期的时钟间隔,使得后续的处理不会将报文头部丢弃
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1
timespace_insert.vhd
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