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基于VHDL的定时计数芯片的设计 通过模块化
基于VHDL的定时计数芯片的设计 通过模块化
VHDL/FPGA/Verilog
197 K
40 次下载
2016-06-08
资源详细信息
文件格式
压缩包
文件大小
197 K
资源分类
VHDL/FPGA/Verilog
上传者
bt9
发布时间
2016-06-08 10:58
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基于VHDL的定时计数芯片的设计 通过模块化 - 资源详细说明
基于VHDL的定时计数芯片的设计 通过模块化,状态图设计实现定时芯片
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基于vhdl的定时计数芯片的设计.pdf
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