💻 基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1101
📄 time_disp_select.pre_map.cdb
0 B
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1102
📄 time_disp_select.cmp.hdb
0 B
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1103
📄 time_disp_select.map.hdb
0 B
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1104
📄 time_disp_select_sim.qrpt
0 B
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1105
📄 time_disp_select.sld_design_entry.sci
0 B
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1106
📄 time_disp_select.sim.hdb
0 B
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1107
📄 time_disp_select.(0).cnf.cdb
0 B
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1108
📄 time_disp_select.hif
874 B
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1109
📄 time_disp_select.eds_overflow
3 B
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1110
📄 time_disp_select.pre_map.hdb
0 B
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1111
📄 time_disp_select.tan.qmsg
55.07 KB
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1112
📄 time_disp_select.sim.qmsg
1.33 KB
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1113
📄 time_disp_select.cmp.rdb
0 B
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1114
📄 time_disp_select.sld_design_entry_dsc.sci
0 B
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1115
📄 time_disp_select.sim.vwf
10.79 KB
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1116
📄 time_disp_select.cmp.cdb
0 B
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1117
📄 time_disp_select.map.cdb
0 B
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1118
📄 time_disp_select.syn_hier_info
0 B
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1119
📄 time_disp_select_cmp.qrpt
0 B
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1120
📄 time_disp_select.cmp.ddb
0 B
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1121
📄 time_disp_select.map.summary
282 B
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1122
📄 time_disp_select.asm.rpt
8.19 KB
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1123
📄 time_disp_select.pin
8.78 KB
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1124
📄 time_disp_select.fit.rpt
30.36 KB
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1125
📄 time_disp_select.fit.eqn
5.72 KB
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1126
📄 time_disp_select.map.rpt
11.65 KB
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1127
📄 cmp_state.ini
2 B
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1128
📄 maincontrol.fit.eqn
2.91 KB
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1129
📄 maincontrol.fit.summary
347 B
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1130
📄 maincontrol.fit.rpt
23.95 KB
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1131
📄 maincontrol.map.summary
270 B
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1132
📄 maincontrol.bsf
3.18 KB
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1133
📄 maincontrol.asm.rpt
8.01 KB
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1134
📄 maincontrol.v
2.1 KB
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1135
📄 maincontrol.qws
184 B
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1136
📄 maincontrol.sim.rpt
4.31 KB
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1137
📄 maincontrol.qpf
1.53 KB
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1138
📄 maincontrol.map.eqn
2.78 KB
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1139
📄 maincontrol.done
26 B
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1140
📄 maincontrol.flow.rpt
3.96 KB
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1141
📄 maincontrol.tan.summary
989 B
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1142
📄 maincontrol.pin
8.78 KB
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1143
📄 maincontrol.sim.rdb
0 B
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1144
📄 maincontrol.pre_map.hdb
0 B
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1145
📄 maincontrol.sld_design_entry_dsc.sci
0 B
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1146
📄 maincontrol.hier_info
600 B
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1147
📄 maincontrol.pre_map.cdb
0 B
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1148
📄 maincontrol.fit.qmsg
1.24 KB
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1149
📄 maincontrol.eco.cdb
0 B
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1150
📄 maincontrol.sim.hdb
0 B
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