💻 基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
951
📄 autodate.sim.rpt
4.31 KB
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952
📄 autodate.fit.rpt
64 KB
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953
📄 autodate.qws
768 B
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954
📄 autodate.flow.rpt
3.93 KB
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955
📄 autodate.map.eqn
14.49 KB
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956
📄 autodate.v
2.77 KB
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957
📄 autodate.qsf
2.4 KB
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958
📄 autodate.done
26 B
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959
📄 autodate.hif
2.73 KB
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960
📄 autodate.sim.qmsg
1.3 KB
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961
📄 autodate.psp
0 B
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962
📄 autodate.hier_info
1.3 KB
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963
📄 autodate.(1).cnf.cdb
0 B
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964
📄 autodate.cmp.cdb
0 B
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965
📄 autodate.(1).cnf.hdb
0 B
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966
📄 autodate.syn_hier_info
0 B
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967
📄 autodate.tan.qmsg
36.56 KB
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968
📄 autodate.asm.qmsg
1.08 KB
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969
📄 autodate.rtlv_sg.cdb
0 B
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970
📄 autodate.cmp.hdb
0 B
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971
📄 autodate.pre_map.hdb
0 B
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972
📄 autodate.rtlv.hdb
0 B
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973
📄 autodate.(0).cnf.cdb
0 B
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974
📄 autodate.pre_map.cdb
0 B
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975
📄 autodate.cmp.ddb
0 B
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976
📄 autodate.db_info
136 B
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977
📄 autodate.map.qmsg
1.02 KB
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978
📄 autodate.(0).cnf.hdb
0 B
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979
📄 autodate.fit.qmsg
1.22 KB
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980
📄 autodate.map.hdb
0 B
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981
📄 autodate.cmp.tdb
0 B
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982
📄 autodate.map.cdb
0 B
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983
📄 autodate.cmp0.ddb
0 B
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984
📄 autodate.sim.rdb
0 B
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985
📄 autodate.rtlv_sg_swap.cdb
0 B
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986
📄 autodate.sld_design_entry.sci
0 B
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987
📄 autodate.sld_design_entry_dsc.sci
0 B
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988
📄 autodate_cmp.qrpt
0 B
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989
📄 autodate.cmp.rdb
0 B
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990
📄 autodate.eds_overflow
5 B
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991
📄 autodate.sgdiff.cdb
0 B
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992
📄 autodate.sgdiff.hdb
0 B
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993
📄 autodate_sim.qrpt
0 B
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994
📄 autodate.sim.hdb
0 B
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995
📄 autodate.eco.cdb
0 B
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996
📄 autodate.sim.vwf
64 KB
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997
📄 autodate.fit.eqn
15.33 KB
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998
📄 autodate.fit.summary
342 B
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999
📄 autodate.pof
0 B
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1000
📄 cmp_state.ini
2 B
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