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本程序实现两个整数平方和相加并且输出结果
本程序实现两个整数平方和相加并且输出结果
VHDL/FPGA/Verilog
4 K
109 次下载
2014-08-15
资源详细信息
文件格式
RAR
文件大小
4 K
资源分类
VHDL/FPGA/Verilog
上传者
novelty1234
发布时间
2014-08-15 14:00
下载统计
109
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本程序实现两个整数平方和相加并且输出结果
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calcu_synthesis.vhd
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