💻 DDR RAM控制器的VHDL源码, 实现平台是Lattice FPGA - 源码文件列表

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源码文件总数： 22 个
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序号
文件名
文件大小
操作
1
📄 rd1020.pdf
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2
📄 footer.gif
0 B
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3
📄 ddr_controller.gif
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4
📄 header.gif
0 B
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5
📄 spacer.gif
0 B
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6
📄 ref_design_logo.gif
0 B
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7
🎨 external.css
11.84 KB
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8
📄 make_agent_emb.jpg
0 B
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9
📄 arrow1.gif
0 B
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10
📄 go.gif
0 B
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11
📄 arrow.gif
0 B
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12
📄 pdfmid.gif
0 B
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13
📄 diskette.gif
0 B
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14
📄 ddr_tb.v
6.42 KB
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15
📄 stimulus.v
7.38 KB
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16
📄 ddr_pll_orca.v
958 B
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17
📄 ddr_top.v
9.39 KB
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18
📄 ddr_par.v
8.95 KB
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19
📄 ddr_ctrl.v
15.29 KB
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20
📄 ddr_sig.v
8.89 KB
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21
📄 ddr_data.v
12.04 KB
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22
📄 ddr_pll_orca_sp.v
960 B
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