💻 Core_PWM,verilog语言编写 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 project.lst
68 B
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2
📄 control.1
844 B
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3
📄 viewdraw.ini
1.63 KB
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4
📄 pll_1_work.ixf
1.04 KB
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5
📄 smartgen.aws
395 B
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6
📄 pll_1.gen
466 B
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7
📄 pll_1.cxf
1.48 KB
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8
📄 pll_1.v
2.43 KB
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9
📄 modelsim.ini
346 B
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10
📄 _primary.vhd
211 B
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11
📄 _info
1.94 KB
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12
📄 _primary.vhd
78 B
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13
📄 _primary.vhd
472 B
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14
📄 _primary.vhd
258 B
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15
📄 _primary.vhd
178 B
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16
📄 _primary.vhd
507 B
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17
📄 _primary.vhd
837 B
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18
📄 meminit.dat
2.75 KB
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19
📄 _info
1.15 KB
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20
📄 _primary.vhd
78 B
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21
📄 _primary.vhd
649 B
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22
📄 _primary.vhd
178 B
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23
📄 _primary.vhd
837 B
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24
📄 run.do
497 B
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25
📄 modelsim.ini.sav
344 B
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26
📄 control.dsk
995 B
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27
📄 control_tbench.v
6.11 KB
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28
📄 top.dsk
991 B
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29
📄 top_tbench.v
5.99 KB
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30
📄 control.hpj
902 B
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31
📃 files_to_build.txt
34 B
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32
📄 top.hpj
894 B
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33
📄 top.plg
1017 B
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34
📄 control.plg
1.32 KB
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35
📄 top.msg
2.23 KB
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36
📄 control.srs
8.65 KB
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37
📄 traplog.tlg
4.18 KB
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38
📄 control_syn.prj
451 B
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39
📄 control.tlg
121 B
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40
📄 top.srm
64 KB
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41
📄 top_syn.prd
278 B
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42
📄 control.areasrr
2.25 KB
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43
📄 top.sdf
64 KB
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44
📄 top.sap
2.51 KB
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45
📄 top.edn
64 KB
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46
📄 control.srm
64 KB
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47
📄 control.sap
2.19 KB
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48
📄 top.srs
21.49 KB
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49
📄 top.fse
264 B
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50
📄 top_sdc.sdc
310 B
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