💻 这是使用VERILOG语言 - 源码文件列表

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源码文件总数： 39 个
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序号
文件名
文件大小
操作
1
📄 func_sim.log
48.36 KB
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2
📄 string_decode_fn.v
5.61 KB
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3
📄 run_sim
176 B
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4
📄 tb_sdrm.v
7.92 KB
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5
📄 func_sim.cfg
1.4 KB
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6
📄 func_sim.vpd
0 B
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7
📄 readme
6.36 KB
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8
📄 mt48lc1m16a1.v
1.02 KB
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9
📃 bank0.txt
200 B
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10
📃 bank1.txt
200 B
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11
📄 mt48lc1m16a1-8a.v
1 KB
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12
📄 test.v
803 B
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13
📄 ref_cntr.v
1.39 KB
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14
📄 define.v
758 B
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15
📄 rcd_cntr.v
1.3 KB
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16
📄 sdrmc_state.v
6.01 KB
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17
📄 sys_int.v
7.39 KB
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18
📄 cslt_cntr.v
1.3 KB
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19
📄 ki_cntr.v
1.27 KB
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20
📄 sdrm.v
13.59 KB
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21
📄 brst_cntr.v
1.38 KB
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22
📄 sdrm_t.v
5 KB
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23
📄 setup.scr
3.16 KB
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24
📄 sdrm.edf
64 KB
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25
📄 run_synth
62 B
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26
📄 sdrm.scr
3.16 KB
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27
📄 sdrm_par.sdf
64 KB
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28
📄 run_par
947 B
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29
📄 sdrm.edf
64 KB
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30
📄 sdrm.ucf
5.04 KB
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31
📄 sdrm_par.v
64 KB
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32
📄 sdrm_par.sdf
64 KB
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33
📄 post_route.cfg
1.33 KB
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34
📄 post_route.vpd
0 B
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35
📄 post_route.log
41.22 KB
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36
📄 run_sim
310 B
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37
📄 tb_post_route.v
7.85 KB
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38
📄 string_decode_post_route.v
1.67 KB
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39
📄 sdrm_par.v
64 KB
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