viterbi译码
接收到的符号首先经过解调器判决，输出0、1码，然后再送往译码器的形式，称为硬判决译码。即编码信道的输出是0、1的硬判决信息。
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2,1,7卷积码的viterbi译码算法的FPGA实现,内容详细,而且附带源代码
2,1,7卷积码的viterbi译码算法的FPGA实现,使用vhdl语言编写，内容详细,而且附带源代码
2022-11-05
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