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锁相环(PLL: Phase-locked loops)是一种利用反馈控制原理实现的频率及相位的同步技术，其作用是将电路输出的时钟与其外部的参考时钟保持同步。当参考时钟的频率或相位发生改变时，锁相环会检测到这种变化，并且通过其内部的反馈系统来调节输出频率，直到两者重新同步，这种同…

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电路图纸

这样做的目的是要说明的应用提供电子系统设计师的必要工具设计和评估锁相环（ PLL ）的配置集成电路。

2013-12-24 125 次下载

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电子书籍

fir低通滤波器用于dspbuilder pll：25ns data 400khz sin 10.8khz

2016-10-08 123 次下载

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电路图纸

PLL电路的研究及在信号产生中的应用论文资料

0114、PLL电路的研究及在信号产生中的应用论文资料

2014-04-09 123 次下载

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源码文件

PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), 数字锁相技术在通信领域应用非常广泛

PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), 数字锁相技术在通信领域应用非常广泛，本例用VHDL描述了一个锁相环作为参考，源码已经调试过。编译器synplicty.Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), …

2013-12-31 122 次下载

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％The phase locked loop(PLL),adjusts the phase of a local oscillator ％w.r.t the incoming modulated

％The phase locked loop(PLL),adjusts the phase of a local oscillator ％w.r.t the incoming modulated signal.In this way,the phase of …

2015-09-28 121 次下载

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技术文档

Jitter is extremely important in systems using PLL-based clock drivers. The effects of jitter range

Jitter is extremely important in systems using PLL-based clock drivers. The effects of jitter range from not having any effect on …

2014-11-25 117 次下载

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压缩工程

三星的有关ARM9的S3C 系列的PLL频率设置软件

三星的有关ARM9的S3C 系列的PLL频率设置软件，ARM开发中可以快速设置所需要的频率参数

2013-12-25 117 次下载

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源码文件

BU2614 PLL 源程序,直接解压

2015-03-07 115 次下载

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电路图纸

基于MC145159的PLL频率合成器设计与实现介绍了锁相环路频率合成器的基本原理,分析了集成锁相环芯片M C 145159的工作特性,给出了集成锁相环芯片M C 145159的一个应用实例,为高

基于MC145159的PLL频率合成器设计与实现介绍了锁相环路频率合成器的基本原理,分析了集成锁相环芯片M C 145159的工作特性,给出了集成锁相环芯片M C 145159的一个应用实例,为高频频率合成器的设计提供了一个较好的思路.测试结果证明了设计的合…

2014-01-17 113 次下载

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源码文件

基于MATLAB的PLL仿真程序

二阶锁相环的仿真

2013-12-19 112 次下载

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