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mc34063仿真输出不了

  • 基于FPGA的数字上变频方法研究

    本论文介绍了毫米波通信系统中常用的上变频方案和调制方式,比较了它们的性能和特点,最终在发射系统中选择了DQPSK调制方式。提出了一种利用数字上变频技术进行基带信号的数字域上变频调制的方法。系统设计采用了现场可编程逻辑器件FPGA和通用正交上变频器AD9857相结合的方案。 本设计硬件平台以AD公司的AD9857为核心,在数字域完成了基带数字信号内插滤波、正交调制、D/A变换等功能;选用ALTERA公司的Cyclone系列EPlC6Q240C8完成了基带数字信号的处理,并实现了对AD9857的控制。软件部分,应用Quartus Ⅱ和硬件描述语言VHDL在FPGA中完成了基带数字信号处理模块(串并转换模块、差分编码模块)和与AD9857的通信模块(串口通信模块、并口通信模块)的设计,并进行了仿真,仿真结果达到了设计要求。整个系统实现了在70MHz中频载波上的DQPSK调制。系统具有结构简单,控制灵活,频率分辨率高,频率变化速率高等优点。

    标签: FPGA 数字 方法研究

    上传时间: 2013-07-18

    上传用户:qoovoop

  • CCK基带调制解调技术的研究实现

    本文重点研究的是补偿编码键控(CCK)的调制与解调算法原理,以及基于FPGA进行的系统设计实现。作为IEEE802.11b标准中关键的调制技术,CCK码具有良好的相关特性,能够在高速率传输数据的同时有效的克服多径效应。本文首先对WLAN的结构和特点进行了简单介绍,对其中的IEEE802.11b标准进行了研究,并着重分析了其物理层基带部分的结构和规范。然后系统的介绍了CCK码的特点,重点对11Mb/s模式下基于“基本CCK码字集”的CCK调制原理和基于快速沃尔什变换(FWT)块的CCK解调原理进行了分析讨论。接下来通过在Matlab中对调制和解调方案的仿真,得到了正确的理论数据,并验证了系统设计的可行性。最后在Xilinx公司的ISE6.2开发环境下,使用硬件描述语言Verilog HDL对CCK调制和解调系统在FPGA中进行了设计,然后将整个系统在ModelSim中进行了功能仿真。理论分析和仿真结果的比较表明系统设计是正确的,而且系统性能良好。 本文所设计的基于FPGA的CCK调制和解调系统具有集成度高、稳定性强和能够在线软件更新等特点。研究成果可以给将来设计更高性能、更高集成度的基带WLAN芯片提供基础。

    标签: CCK 基带 调制 解调技术

    上传时间: 2013-06-02

    上传用户:yoleeson

  • 基于FPGA的GPIB控制器的IP核设计

    当前,片上系统(SOC)已成为系统实现的主流技术。流片风险与费用增加、上市时间压力加大、产品功能愈加复杂等因素使得SOC产业逐渐划分为IP提供者、SOC设计服务者和芯片集成者三个层次。SOC设计已走向基于IP集成的平台设计阶段,经过严格验证质量可靠的IP核成为SOC产业中的重要一环。 GPIB控制器芯片是组建自动测试系统的核心,在测试领域应用广泛。本人通过查阅大量的技术资料,分析了集成电路在国内外发展的最新动态,提出了基于FPGA的自主知识产权的GPIB控制器IP核的设计和实现。 本文首先讨论了基于FPGA的GPIB控制器的背景意义,接着对FPGA开发所具备的基本知识作了简要介绍。文中对GPIB总线进行了简单的描述,根据芯片设计的主要思想,重点在于论述怎样用FPGA来实现IEEE-488.2协议,并详细阐述了GPIB控制器的十种接口功能及其状态机的IP核实现。同时,对数据通路也进行了较为细致的说明。在设计的时候采用基于模块化设计思想,用VerilogHDL语言完成各模块功能描述,通过Synplifv软件的综合,用Modelsim对设计进行了前、后仿真。最后利用生成的模块符号采取类似画电路图的方法完成整个系统芯片的lP软核设计,并用EDA工具下载到了FPGA上。 为了更好地验证设计思想,借助EDA工具对GPIB控制器的工作状态进行了软件仿真,给出仿真结果,仿真波形验证了GPIB控制器的工作符合预想。最后,本文对基于FPGA的GPIB控制器的IP核设计过程进行了总结,展望了当前GPIB控制器设计的发展趋势,指出了开展进一步研究需要做的工作。

    标签: FPGA GPIB 控制器 IP核

    上传时间: 2013-04-24

    上传用户:rockjablew

  • 基于FPGA的PCI数据采集卡的研究与开发

    随着信息技术和电子技术的进步和日益成熟,计算机数据采集技术得到了广泛应用。由于ISA数据采集卡的固有缺陷,PCI接口的数据采集卡将逐渐取代ISA数据采集卡,成为数据采集的主流。为了简化PCI数据采集卡结构,提高数据采集可靠性,本文研究并开发了一种基于FPGA的PCI结构的数据采集卡系统。 论文对PCI对目标设备数据采集卡实现的原理和方法进行了深入研究,设计了基于FPGA的PCI数据采集卡的硬件电路,通过在FPGA中嵌入了PCI目标设备的IP核与用户逻辑部分,构成了SOPC系统。使用Verilog硬件描述语言设计并实现了FPGA内部采集数据管理、数据管理寄存器和FIFO数据缓冲队列等模块电路。利用ModelSim对PCI系统进行了仿真。完成了系统硬件电路PCB板的设计,最终制作了PCI数据采集卡。 论文针对PCI结构的数据采集卡系统软件需求,研究了WDM设备驱动软件、Windows环境的简易虚拟示波器以及简易虚拟逻辑仪实现原理和方法。利用DriverStudio+Windows DDK for XP+VC6的软件平台,开发了WDM设备驱动程序。实现了Windows环境的简易虚拟示波器,和简易虚拟逻辑仪。系统测试结果表明该系统设计正确,系统运行稳定,功能和指标达到了设计要求。

    标签: FPGA PCI 数据采集卡

    上传时间: 2013-07-22

    上传用户:z754970244

  • 基于FPGA的路径识别图像传感器的设计

    基于彩色路径识别的视觉导航方法是当前自动导航小车领域的研究热点和方向。视觉导航是指根据地面路径和被控对象之间的位置偏差控制其运行的方向,因此,地面彩色路径图像的摄取及其识别处理就成为视觉导航系统中的基础和关键。在当前的视觉导航系统设计中,图像处理的硬件平台都是基于通用微处理器,嵌入式微处理器或者DSP进行设计的。这些处理器一个共同的特点就是数据串行处理,而图像处理过程涉及大量的并行处理操作,因此传统的串行处理方式满足不了图像处理的实时性要求。 鉴于微处理器这方面的不足,作者提出一种使用FPGA实现图像识别的并行处理方案,并据此设计一个智能图像传感器。该传感器采用先进的FPGA技术,将图像采集及其显示,路径的识别处理以及通信控制等模块集成在一个芯片上,形成一个片上系统(SOC)。其主要功能是对所采集的彩色路径图像进行识别处理,获得彩色路径的坐标及其方向角,并将处理结果发送给上位机,为自动导航提供控制依据。 本文将彩色路径的识别处理过程划分为三个阶段,第一阶段为颜色聚类识别,以获得二值路径图像,第二阶段为数学形态学运算,用于对第一阶段中获得的二值图像进行去斑处理,第三阶段为路径中心线的定位及其方向角的测量。图像传感器与上位机的通信采用异步串行方式,由于上位机需要控制该传感器执行多种任务,作者定义一种基于异步串行通信的应用层协议,用于上位机对传感器的控制。在图像的显示中,为了弥补图像采集的速率和VGA显示速率的不匹配,作者提出一种基于单端口存储器的图像帧缓冲机制,通过VGA接口将采集的图像实时地显示出来。 根据上述思想,作者完成了系统的硬件电路设计,并对整个系统进行了现场调试。调试结果表明,传感器系统的各个模块都能正常工作,FPGA中的数字逻辑电路能够实时地将路径从图像中准确地识别出来,.充分体现了FPGA对路径图像的高速处理优势,达到了设计预期目标,在一定程度上丰富了路径图像识别处理的技术和方法。

    标签: FPGA 路径识别 图像传感器

    上传时间: 2013-04-24

    上传用户:ghostparker

  • 基于FPGA的可测性设计方法研究

    现场可编程门阵列(FPGA)是一种现场可编程专用集成电路,它将门阵列的通用结构与现场可编程的特性结合于一体,如今,FPGA系列器件已成为最受欢迎的器件之一。随着FPGA器件的广泛应用,它在数字系统中的作用日益变得重要,它所要求的准确性也变得更高。因此,对FPGA器件的故障测试和故障诊断方法进行更全面的研究具有重要意义。随着FPGA器件的迅速发展,FPGA的密度和复杂程度也越来越高,使大量的故障难以使用传统方法进行测试,所以人们把视线转向了可测性设计(DFT)问题。可测性设计的提出为解决测试问题开辟了新的有效途径,而边界扫描测试方法是其中一个重要的技术。 本文对FPGA的故障模型及其测试技术和边界扫描测试的相关理论与方法进行了详细的探讨,给出了利用布尔矩阵理论建立的边界扫描测试过程的数学描述和数学模型。论文中首先讨论边界扫描测试中的测试优化问题,总结解决两类优化问题的现有算法,分别对它们的优缺点进行了对比,进而提出对两种现有算法的改进思想,并且比较了改进前后优化算法的性能。另外,本文还对FPGA连线资源中基于边界扫描测试技术的自适应完备诊断算法进行了深入研究。在研究过程中,本文基于自适应完备诊断的思想对原有自适应诊断算法的性能进行了分析,并将独立测试集和测试矩阵的概念引入原有自适应诊断算法中,使改进后的优化算法能够简化原算法的实现过程,并实现完备诊断的目标。最后利用测试仿真模型证明了优化算法能够更有效地实现完备诊断的目标,在紧凑性指标与测试复杂性方面比现在算法均有所改进,实现了算法的优化。

    标签: FPGA 可测性设计 方法研究

    上传时间: 2013-06-30

    上传用户:不挑食的老鼠

  • 基于FPGA的数字下变频器

    本文设计和实现了基于FPGA的数字下变频器DDC,用于宽带数字中频软件无线电接收机中。采用自上向下的模块化设计方法,将DDC的功能划分为基本单元,实现这些功能模块并组成模块库。在具体应用时,优化配置各个模块来满足具体无线通信系统性能的要求。这样做比传统ASIC数字下变频器具有更好的可编程性和灵活性,从而满足不同的工程设计需求。 首先阐述了软件无线电中关键的数字信号处理技术,包括中频处理中的下变频技术、抽取技术以及带通采样技术。利用MATLAB的Simulink完成了对系统的设计与仿真,验证了设计的正确性。之后用QuartusII进行了基于FPGA抽取滤波器和NCO等关键模块的设计,编译后进行了时序仿真,最后在PCB板上实现了实际电路并应用于工程项目中。

    标签: FPGA 数字下变频

    上传时间: 2013-08-05

    上传用户:lishuoshi1996

  • 基于FPGA的便携式振动频谱分析仪

    该论文基于NIOS Ⅱ软核处理器和Altera的FPGA技术,设计了一种便携式的振动频谱分析仪,用于旋转机械的故障监测和诊断。以SOPC技术为手段,将信号采集和信号处理电路通过可编程片上系统来实现,其特点是将对ADC的控制、数字信号的滤波、快速傅立叶变换的设计,通过FPGA芯片集成在一起,以NIOS Ⅱ来完成32位CPU的状态控制功能。工程机械、汽车车辆中都存在诸如发动机类的旋转机械,这类设备的异常振动往往会影响正常工作,严重时还会出现各种重大事故,该分析仪可以实时地或定期地对发动机、齿轮箱等旋转机械进行振动频谱分析和监测,运用于民用机械能产生非常好的经济效益。 该论文从四个方面进行了研究工作。其一,利用FPGA对ADC芯片的工作进行控制,使其在规定的时间内与DSP模块进行数据交换,并对ADC各引脚时序进行控制,使两者协调同步工作,编制了相应的VHDL语言程序。其二,采用SOPC Builder设计开发,实现了基于NIOS Ⅱ的32位CPU软核,创建了相应的C/C++和汇编的宏代码,使得软件可以访问用户自定义逻辑。对顶层设计产生的VHDL的RTL代码和仿真文件进行了综合、编译适配以及仿真。其三,配合Matlab和DSP Builder的强大功能进行DSP模块设计,开发出了FIR和FFT等功能模块,并且添加到SOPC系统中,使其可以由NIOS Ⅱ很容易的调用。其四,在NIOS Ⅱ系统中添加了uC/OS Ⅱ操作系统,提高了整个系统的稳定性,并且降低了开发难度,提高了系统升级的能力。由于整个设计是基于FPGA开发的,所以该系统包括了所有FPGA系统的特点,包括并行的DSP处理、在系统可编程、升级简单等特点,极易使设计产品化。

    标签: FPGA 便携式 振动频谱 分析仪

    上传时间: 2013-04-24

    上传用户:amandacool

  • 高精度地震勘探数据采集系统

    本文分析了当代高精度地震勘探数据采集系统的发展现状,研究了数据采集的A/D方法及理论、现场可编程门阵列(Field Programmable GateArray,FPGA)技术的发展及原理,串口通信的原理及实现。在此基础上,探讨了采用FPGA控制24位△∑模数转换器来实现高精度地震勘探数据采集系统的实现思路,对探测传感器或检波器后端数据采集系统的信号A/D转换、FPGA与外部接口设计、串口数据通信做了详细的研究,尤其是在用FPGA来完成与外部ADC的接口控制上做了深入的开发和设计,整个接口控制模块采用VHDL语言编写,并同时将ROM、FIFO等数字逻辑模块一起集成到一片FPGA芯片当中,并在Quartus Ⅱ6.0的开发平台上通过了软件仿真,时序仿真结果达到了系统要求。

    标签: 高精度 地震勘探 数据采集系统

    上传时间: 2013-05-21

    上传用户:yuele0123

  • 基于FPGA的高速IIR数字滤波器

    数字滤波器是现代数字信号处理系统的重要组成部分之一。ⅡR数字滤波器又是其中非常重要的一类虑波器,因其可以较低的阶次获得较高的频率选择特性而得到广泛应用。 本文研究了ⅡR数字滤波器的常用设计方法,在分析各种ⅡR实现结构的基础上,利用MATLAB针对并联型结构的ⅡR数字滤波器做了多方面的仿真,从理论分析和仿真情况确定了所要设计的ⅡR数字滤波器的实现结构以及中间数据精度。然后基于FPGA的结构特点,研究了ⅡR数字滤波器的FPGA设计与实现,提出应用流水线技术和并行处理技术相结合的方式来提高ⅡR数字滤波器处理速度的方法,同时又从ⅡR数字滤波器的结构特性出发,提出利用ⅡR数字滤波器的分解技术来改善ⅡR滤波器的设计。在ⅡR实现方面,本文采用Verilog HDL语言编写了相应的硬件实现程序,将内置SignalTap Ⅱ逻辑分析器的ⅡR设计下载到FPGA芯片,并利用Altera公司的SignalTap Ⅱ逻辑分析仪进行了定性测试,同时利用HP频谱仪进行定性与定量的观测,仿真与实验测试结果表明设计方法正确有效。

    标签: FPGA IIR 数字滤波器

    上传时间: 2013-04-24

    上传用户:lmq0059