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　　IP核生成文件：（Xilinx/Altera 同）　　IP核生成器生成 ip 后有两个文件对我们比较有用，假设生成了一个 asyn_fifo 的核，则asyn_fifo.veo 给出了例...

📅 2013-10-20

7.4 基于IP CORE的BLOCK RAM设计修改稿。...

📅 2013-11-07

提出一种以现场可编程门阵列（FPGA）为硬件核心的钢丝绳漏磁无损检测系统设计方案，设计了外围电路并对嵌入式IP软核进行了配置，利用C语言和VHDL硬件描述语言编写了检测系统软件程序。实验表明该系统具有...

📅 2015-01-01

定制简单LED的IP核的设计源代码...

📅 2013-10-19

　　这一节的目的是使用XPS为ARM PS 处理系统添加额外的IP。从IP Catalog 标签添加GPIO，并与ZedBoard板子上的8个LED灯相连。当系统建立完后，产生bitstream...

📅 2013-11-06

对于利用LabVIEW FPGA实现RIO目标平台上的定制硬件的工程师与开发人员，他们可以很容易地利用所推荐的组件设计构建适合其应用的、可复用且可扩展的代码模块。基于已经验证的设计进行代码模块开发，将...

📅 2013-10-14

　　QuartusII中利用免费IP核的设计　　作者：雷达室　　以设计双端口RAM为例说明。　　Step1：打开QuartusII，选择File—New Projec...

📅 2013-10-18

基于FPGA的GPIB接口IP核的研究与设计...

📅 2013-10-19

ISE新建工程及使用IP核步骤详解...

📅 2015-01-01

以Altera公司的Quartus Ⅱ 7.2作为开发工具，研究了基于FPGA的DDS IP核设计，并给出基于Signal Tap II嵌入式逻辑分析仪的仿真测试结果。将设计的DDS IP核封装成为S...

📅 2013-12-22

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