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ewb-v

  • 基于PSD的微位移传感器建模的实现方法

      为了正确反映基于光电位置敏感器(PSD)的微位移传感器的特性,首先介绍了一维光电位置敏感器的工作原理并分析了利用PSD结合光学三角测量法将位移信号转换成电压信号的工作原理,得出基于PSD的微位移传感器被测试件位移量与相关测量电路输出电压(S,V)关系特征,然后基于最小二乘估计算法基本原理, 提出了运用MATLAB语言建立PSD的为了正确反映基于光电位置敏感器(PSD)的微位移传感器的特性,首先介绍了一维光电位置敏感器的工作原理并分析了利用PSD结合光学三角测量法将位移信号转换成电压信号的工作原理,得出基于PSD的微位移传感器被测试件位移量与相关测量电路输出电压(S,V)关系特征,然后基于最小二乘估计算法基本原理, 提出了运用MATLAB语言建立PSD的微位移传感器(S,V)关系特征的数学模型的方法, 给出了建模的程序流程图以及仿真结果。微位移传感器(S,V)关系特征的数学模型的方法, 给出了建模的程序流程图以及仿真结果。

    标签: PSD 微位移传感器 建模 实现方法

    上传时间: 2014-07-26

    上传用户:R50974

  • 电子电路百科全书

    该电路集包括了从业界享有盛名的公司搜集到的大量最新电路,体现了丰富的设计思想。为便于读者理解和应用这些电路,本书几乎对每个电路都附有简要说明。$ C' I" t% P5 l3 V. l0 K, B 本书可供电子技术工作者、高等院校和中等专科学校师生、电子爱好者阅读和参考。( H& s, \, z6 ~% D: @

    标签: 电子电路 百科

    上传时间: 2013-10-19

    上传用户:songnanhua

  • MOTION BUILDER 使用说明书Ver.2

    MOTION BUILDER Ver.2 是用于监控 KV-H20/H20S/H40S/H20G 的参数设定以及当前动作状态的软件。 在 PC 上可以设定复杂的参数,并可以在显示画面上监控正在运行的 KV-H20/H20S/H40S/H20G。 关于 MOTION BUILDER Ver.2 概要、功能与使用方法的详细说明。在安装之前,请仔细阅读本手册,并充分 理解。 注意 1、使用 MOTION BUILDER Ver.2 时,必须在可以使用 KV-H20/H20S/H40S/H20G 上 连接的紧急停止开关的地方使用。 通讯异常时,不接受 MOTION BUILDER Ver.2 的“强制停止”,可能会导致事故指示发生。发生通信异常时,MOTION BUILDER Ver.2 的“强制停止”按钮将不起作用。 2、JOG 过程中,不能采用断开 PLC 的连接电缆等手段停止通讯。 KV-H20/H20S/H40S/H20G 单元的 JOG 继电器会一直保持 ON,机器继续运转,并可能导致事故发生。 3、执行监控或者写入参数(设定)时,不能断开和 PLC 的连接电缆。 否则会发生通讯错误,PC 可能会被重启。KV-H20/H20S/H40S/H20G 内的数据可 能会损坏。 4、在 RUN 过程中,KV-1000/700 进行 JOG 示教时,必须在 PROG 模式下实施。 如果扫描时间较长,则反映的时间变长,且可能发生无法预料的动作。 5、发送到  KV-1000/700  的单元设定信息必须与当前打开的梯形图程序的单元设定信 息一致。如果设定信息不同,则显示错误,且不运行。 6、错误操作或者静电等会引起数据变化或者去失,为了保护数据,请定期进行备份。 指示 关于数据的变化或者消失引起的损失,本公司不负任何责任,请谅解。 7、保存数据时,如果需要保留原来保存的数据,则选择“重命名保存”。 如果“覆盖保存”则会失去原来保存的数据。 运行环境及系统配置 运行 MOTION BUILDER Ver.2 ,必须具备如下环境。 请确认您使用的系统是否符合如下条件、是否备齐了必需的设备。 对应的 PC 机型 •  IBM PC 以及 PC/AT 兼容机(DOS/V) 系统配置 •  CPU Pentium 133 MHz 以上 支持 Windows 的打印 (推荐 Pentium 200 MHz 以上) •  内存容量扩展内存  64MB 以上 •  硬盘可用空间  20MB 以上 •  CD-ROM 驱动器 •  接口  RS-232C 或者 USB

    标签: BUILDER MOTION Ver 使用说明书

    上传时间: 2013-10-08

    上传用户:fujiura

  • 单片机开发板配套52个程序(c语言源代码)

    买的开发板上带的52个应用于实物的程序,希望对大家有帮助

    标签: 单片机开发板 c语言 程序 源代码

    上传时间: 2013-11-04

    上传用户:xymbian

  • ADI在线工具简化工程师的设计

      创新、效能、卓越是ADI公司的文化支柱。作为业界公认的全球领先数据转换和信号调理技术领先者,我们除了提供成千上万种产品以外,还开发了全面的设计工具,以便客户在整个设计阶段都能轻松快捷地评估电路。

    标签: ADI 在线工具 工程师

    上传时间: 2013-11-25

    上传用户:kachleen

  • EWB电路仿真软件(使用方便简单)

    这个可以仿真电路!

    标签: EWB 电路仿真软件

    上传时间: 2013-11-24

    上传用户:ddddddos

  • PCB阻抗匹配计算工具(附教程)

    附件是一款PCB阻抗匹配计算工具,点击CITS25.exe直接打开使用,无需安装。附件还带有PCB连板的一些计算方法,连板的排法和PCB联板的设计验验。 PCB设计的經驗建議:       1.一般連板長寬比率為1:1~2.5:1,同時注意For FuJi Machine:a.最大進板尺寸為:450*350mm,       2.針對有金手指的部分,板邊處需作掏空處理,建議不作為連板的部位.     3.連板方向以同一方向為優先,考量對稱防呆,特殊情況另作處理.     4.連板掏空長度超過板長度的1/2時,需加補強邊.       5.陰陽板的設計需作特殊考量.       6.工藝邊需根據實際需要作設計調整,軌道邊一般不少於6mm,實際中需考量板邊零件的排布,軌道設備正常卡壓距離為不少於3mm,及符合實際要求下的連板經濟性.       7.FIDUCIAL MARK或稱光學定位點,一般設計在對角處,為2個或4個,同時MARK點面需平整,無氧化,脫落現象;定位孔設計在板邊,為對稱設計,一般為4個,直徑為3mm,公差為±0.01inch.       8.V-cut深度需根據連板大小及基板板厚考量,角度建議為不少於45°.       9.連板設計的同時,需基於基板的分板方式考量<人工(治具)還是使用分板設備>.  10.使用針孔(郵票孔)聯接:需請考慮斷裂后的毛刺,及是否影響COB工序的Bonding机上的夾具穩定工作,還應考慮是否有無影響插件過軌道,及是否影響裝配組裝. 

    标签: PCB 阻抗匹配 计算工具 教程

    上传时间: 2014-12-31

    上传用户:sunshine1402

  • V带传动

    软件

    标签: 传动

    上传时间: 2013-11-14

    上传用户:zukfu

  • Electronic Workbench V5.0c/5.2(汉化版)

         ELECTRONICS  WORKBENCH  EDA(以下简称EWB)软件是交互图像技术有限公司(INTERACTIVE  IMAGE  TECHNOLOGIES  Ltd)在八十年代末推出的EDA软件,其EWB5.0于96年推出,占用硬盘空间很小,只有16M,是个模拟电路和数字电路混合仿真的EDA软件,它的仿真功能十分强大,可以几乎100%地仿真出真实电路的结果,而且它在桌面上提供了各种各样的电子工具,如万用表、示波器、信号发生器、逻辑分析仪等等,它的器件库中则包含了许多大公司的晶体管元器件、集成电路和数字门电路,器件库中没有的元器件,还可以由外部模块导入,在众多的电路仿真软件中,EWB是最容易学会的,它的工作界面非常直观,原理图和各种工具都在同一个窗口内,未接触过它的人稍加学习就可以很熟练地使用该软件,对于电子设计工作者来说,它是个极好的EDA工具,许多电路你无需动用烙铁就可得知它的结果,而且若想更换元器件或改变元器件参数,只需点点鼠标即可,它也可以作为电学知识的辅助教学软件使用,利用它可以直接从屏幕上看到各种电路的输出波形。EWB的兼容性也较好,其文件格式可以导出成能被ORCAD或PROTEL读取的格式,它是笔者最喜欢的EDA软件之一,

    标签: Electronic Workbench 5.0 5.2

    上传时间: 2013-10-21

    上传用户:wangyi39

  • 如何仿真IP核(建立modelsim仿真库完整解析)

      IP核生成文件:(Xilinx/Altera 同)   IP核生成器生成 ip 后有两个文件对我们比较有用,假设生成了一个 asyn_fifo 的核,则asyn_fifo.veo 给出了例化该核方式(或者在 Edit-》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式)。asyn_fifo.v 是该核的行为模型,主要调用了 xilinx 行为模型库的模块,仿真时该文件也要加入工程。(在 ISE中点中该核,在对应的 processes 窗口中运行“ View Verilog Functional Model ”即可查看该 .v 文件)。如下图所示。

    标签: modelsim 仿真 IP核 仿真库

    上传时间: 2013-10-20

    上传用户:lingfei